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参数资料
| 型号： | HW-SD3400A-DSP-DB-UNI-G |
| 厂商： | Xilinx Inc |
| 文件页数： | 19/50页 |
| 文件大小： | 0K |
| 描述： | KIT DEVELOPMENT SPARTAN 3ADSP |
| 产品变化通告： | Adapter Replacement 23/May/2008 |
| 标准包装： | 1 |
| 系列： | Spartan®-3A |
| 类型： | DSP FPGA |
| 适用于相关产品： | Spartan?-3A DSP 3400A |
| 所含物品： | 平台和电源 |
| 配用： | HW-FMC-VIDEO-DC-G-ND - HARDWARE FMC-VIDEO DAUGHTER CARD |
| 相关产品： | XC3SD3400A-4CSG484I-ND - IC FPGA SPARTAN-3A DSP 484-CSBGA XC2C64A-5CPG56C-ND - IC CR-II CPLD 64MCELL 56-CSBGA XC2C64A-5VQG100C-ND - IC CR-II CPLD 64MCELL 100-VQFP 122-1706-ND - IC CR-II CPLD 64MCELL 56-CSBGA 122-1707-ND - IC CR-II CPLD 64MCELL 100-VQFP 122-1708-ND - IC CR-II CPLD 64MCELL 44-VQFP XC3SD3400A-5FGG676C-ND - SPARTAN-3ADSP FPGA 3400K 676FBGA XC3SD3400A-5FG676C-ND - SPARTAN-3ADSP FPGA 3400K 676FBGA XC3SD3400A-5CSG484C-ND - SPARTAN-3ADSP FPGA 3400K 484CSA XC3SD3400A-5CS484C-ND - SPARTAN-3ADSP FPGA 3400K 484CSA 更多... |
| 其它名称： | 122-1532 |
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R
Spartan-3A DSP 3400A Edition Board Hardware
7. Board Flash PROM
Xilinx XCF32P. This flash PROM is used to program the development board FPGA.
The flash PROM can hold up to two distinct configuration images (up to four
compressed configuration images) that can be accessed through the configuration DIP
switches. Requires that you use the same configuration DIP switches to configure the
FPGA from the platform flash PROM. See “33. Configuration DIP Switches” for
detailed information.
8. Ethernet PHY
Marvell Alaska 88E1111 PHY device. This PHY supports 10Base-T, 100Base-TX, and
1000Base-T (Gigabit) Ethernet. The PHY is connected to the board's Ethernet connector
when the development board is turned on or reset. Jumper JP2 selects whether the
PHY's default is RGMII mode (pins 2-3) or GMII mode (pins 1-2). Table 1-4 defines the
default configuration of the Ethernet PHY, which can be modified through software.
Table 1-4:
Default Ethernet PHY Configuration
Configuration Pin
CONFIG0
CONFIG1
CONFIG2
CONFIG3
CONFIG4
CONFIG5
Board Connection
V cc 2.5 V
Ground
V cc 2.5 V
V cc 2.5 V
V cc 2.5 V or
LED_DUPLEX
V cc 2.5 V
Bit 2
PHYADR[2] = 1
ENA_PAUSE = 0
ANEG[3] = 1
ANEG[0] = 1
HCWCFG_MODE
[2] = 0 or 1
DIS_FC = 1
Bit 1
PHYADR[1] = 1
PHYADR[4] = 0
ANEG[2] = 1
ENA_XC = 1
HCWCFG_MODE
[1] = 1
DIS_SLEEP = 1
Bit 0
PHYADR[0] = 1
PHYADR[3] = 0
ANEG[1] = 1
DIS_125 = 1
HCWCFG_MODE
[0] = 1
HCWCFG_MODE
[3] = 1
CONFIG6
LED_RX
SEL_BDT = 0
INT_POL = 1
50/75 ohm = 0
(50 ohm termination)
Table 1-5:
Ethernet Interface Pin Assignments
FPGA Pin
AB13
AC10
AC6
AE4
AD6
AE9
AC17
AF17
AD9
Description
PHY_COL
PHY_CRS
PHY_INT
PHY_MDC
PHY_MDIO
PHY_RESET_N
PHY_RXCTL_RXDV
PHY_RXD_0
PHY_RXD_1
FPGA Pin
AA14
AC13
AE17
W13
V12
AB9
W12
AC9
AA12
Description
PHY_RX_CLK
PHY_RX_ER
PHY_TXCTL_TXEN
PHY_TXC_GTXCLK
PHY_TXD_0
PHY_TXD_1
PHY_TXD_2
PHY_TXD_3
PHY_TXD_4
Spartan-3A DSP 3400A Edition User Guide
UG498 (v2.2) November 17, 2008
19
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