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参数资料
| 型号： | HW-SD3400A-DSP-DB-UNI-G |
| 厂商： | Xilinx Inc |
| 文件页数： | 31/50页 |
| 文件大小： | 0K |
| 描述： | KIT DEVELOPMENT SPARTAN 3ADSP |
| 产品变化通告： | Adapter Replacement 23/May/2008 |
| 标准包装： | 1 |
| 系列： | Spartan®-3A |
| 类型： | DSP FPGA |
| 适用于相关产品： | Spartan?-3A DSP 3400A |
| 所含物品： | 平台和电源 |
| 配用： | HW-FMC-VIDEO-DC-G-ND - HARDWARE FMC-VIDEO DAUGHTER CARD |
| 相关产品： | XC3SD3400A-4CSG484I-ND - IC FPGA SPARTAN-3A DSP 484-CSBGA XC2C64A-5CPG56C-ND - IC CR-II CPLD 64MCELL 56-CSBGA XC2C64A-5VQG100C-ND - IC CR-II CPLD 64MCELL 100-VQFP 122-1706-ND - IC CR-II CPLD 64MCELL 56-CSBGA 122-1707-ND - IC CR-II CPLD 64MCELL 100-VQFP 122-1708-ND - IC CR-II CPLD 64MCELL 44-VQFP XC3SD3400A-5FGG676C-ND - SPARTAN-3ADSP FPGA 3400K 676FBGA XC3SD3400A-5FG676C-ND - SPARTAN-3ADSP FPGA 3400K 676FBGA XC3SD3400A-5CSG484C-ND - SPARTAN-3ADSP FPGA 3400K 484CSA XC3SD3400A-5CS484C-ND - SPARTAN-3ADSP FPGA 3400K 484CSA 更多... |
| 其它名称： | 122-1532 |
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R
Spartan-3A DSP 3400A Edition Board Hardware
20. Clock Generator
IDT IDT5V9885PFGI. Used to generate different clocks on the Spartan-3A DSP 3400A
Edition board. Table 1-14 summarizes the default settings of output clocks. The clock
Table 1-14:
Clock Generator Default Settings
Clock
Generator
Output
1
2
3
4_P
4_N
5_P
5_N
6
FPGA Pin (if
Connected to
FPGA)
NA
NA
NA
NA
AE13
AA13
Y13
AF13
Default
Frequency
25 MHz
14.31818 MHz
12 MHz
31.25 MHz
31.25 MHz
125 MHz
125 MHz
27 MHz
Clock Usage
Ethernet PHY clock
Audio codec clock
USB clock
System ACE clock
FPGA clock
FPGA LVDS differential clock P
FPGA LVDS differential clock N
FPGA clock
21. 64-Kb I 2 C EEPROM
The I 2 C EEPROM 24LC64 can be used to store non-volatile data, for example, an
Addressing” ). The EEPROM write-protect is disabled on the board. I 2 C bus pull-up
resistors are provided on the board.
The I 2 C bus is extended to the FMC expansion connector so that the board can access
additional I 2 C devices and share the I 2 C controller in the FPGA.
Table 1-15:
I 2 C FPGA Pin Assignments
I 2 C Signal
IIC_SCLK
IIC_SDAT
FPGA Pin
AF23 (1)
AE25 (1)
Description
I 2 C clock
I 2 C data
1. I 2 C bus connected to FPGA through I 2 C MUX (U1). MUX needs
to be configured for the proper channel.
22. I 2 C Fan Controller and Temperature/voltage Monitor
Onboard temperature and voltage monitoring and control are handled by an Analog
Addressing” ) and do the following:
?
?
?
?
Measure the voltage of the 5-V, 3.3-V, 1.8-V, and 1.0-V supplies
Measure the FPGA temperature through the DXP/DXN pins on the FPGA
Measure ambient temperature
Read power good status signals from the 2.5-V linear regulators
Spartan-3A DSP 3400A Edition User Guide
UG498 (v2.2) November 17, 2008
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