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参数资料
型号： HW-V4-ML405-UNI-G-J
厂商： Xilinx Inc
文件页数： 17/35页
文件大小： 0K
描述： EVALUATION PLATFORM VIRTEX-4
标准包装： 1
系列： Virtex®-4
类型： FPGA
适用于相关产品： XC4VFX20-FF672
所含物品： 评估平台，小型闪存卡，DDR2 DImm，LCD 显示器 - 不包括电源 -
R
Detailed Description
10. Expansion Headers
The board contains expansion headers (U3, U4, U5, and U6) for easy expansion or
adaptation of the board for other applications. The expansion connectors use standard
0.1-inch headers. The expansion connectors contain connections to single-ended and
differential FPGA I/Os, ground, 2.5V/3.3V/5V power, JTAG chain, and the IIC bus. All
signals on connectors U5 and U6 have matched length traces that are matched to each
other.
Differential Expansion I/O Connectors
Header J5 contains 16 pairs of differential signal connections to the FPGA I/Os. This
permits the signals on this connector to carry high-speed differential signals, such as LVDS
data. All differential signals are routed with 100 Ω differential trace impedance. Matched
length traces are used across all differential signals on U5. Consequently, these signals
connect to the FPGA I/O and they can be used as independent single-ended nets. The
V CCIO of these signals can be set to 2.5V or 3.3V by setting jumpers J15, J16, and J23.
Table 1-8 summarizes the differential connections on this expansion I/O connector.
Table 1-8:
Expansion I/O Differential Connections (J5)
J5 Differential Pin Pair
Schematic Net Name
FPGA Pin
Pos
4
8
12
16
20
24
28
32
36
40
44
48
52
56
60
64
Neg
2
6
10
14
18
22
26
30
34
38
42
46
50
54
58
62
Pos
HDR2_4
HDR2_28
HDR2_20
HDR2_12
HDR2_8
HDR2_60
HDR2_56
HDR2_52
HDR2_36
HDR2_16
HDR2_64
HDR2_48
HDR2_24
HDR2_44
HDR2_32
HDR2_40
Neg
HDR2_2
HDR2_26
HDR2_18
HDR2_10
HDR2_6
HDR2_58
HDR2_54
HDR2_50
HDR2_34
HDR2_14
HDR2_62
HDR2_46
HDR2_22
HDR2_42
HDR2_30
HDR2_38
Pos
Y22
AC19
AA18
AD16
U19
AB20
W20
W18
AB22
W21
AB24
AD24
AA24
AA20
V21
AC23
Neg
AA22
AC18
Y18
AC16
T18
AB19
W19
V18
AB21
Y20
AC24
AD23
AA23
AA19
U21
AC22
ML405 Evaluation Platform
UG210 (v1.5.1) March 10, 2008
www.xilinx.com
17
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