参数资料
型号: ICS1524AM
厂商: INTEGRATED DEVICE TECHNOLOGY INC
元件分类: 时钟产生/分配
英文描述: 250 MHz, OTHER CLOCK GENERATOR, PDSO24
封装: 0.300INCH, SOIC-24
文件页数: 22/24页
文件大小: 354K
代理商: ICS1524AM
7
ICS1524A
ICS1524A Rev D 12/23/2005
Name:
Loop Control Register
Register:
1h
Index:
Read / Write*
Bit Name Bit #
Reset Value
Description
PFD0 -2
0 - 2
0
Charge Pump Gain
Reserved
3
0
Reserved
PSD 0-1
4 - 5
0
Post-Scaler Divider
Reserved
6 -7
0
Reserved
Bit
Name
Description
0-2
PFD0-2
Charge Pump Gain
3
Reserved
4-5
PSD 0-1
Post-Scaler Divider — Divides the output of the VCO to the DPA and Feedback Divider.
6-7
Reserved
*Double-buffered register. Actual working registers are loaded during software PLL reset.
See register 8h for details.
2
t
i
B1
t
i
B0
t
i
B2
/
A
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CP
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01
4
10
8
11
6
1
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PDF描述
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