参数资料
型号: ICS2509DG
厂商: INTEGRATED DEVICE TECHNOLOGY INC
元件分类: 时钟及定时
英文描述: 2509 SERIES, PLL BASED CLOCK DRIVER, 9 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO24
封装: 4.40 MM, 0.65 MM PITCH, PLASTIC, MO-153, TSSOP-24
文件页数: 4/9页
文件大小: 149K
代理商: ICS2509DG
4
ICS2509C
0008D—03/31/03
Symbol
Parameter
Test Conditions
Min.
Max.
Unit
Fclk
Input clock frequency
25
175
MHz
Input clock frequency
duty cycle
40
60
%
Stabilization time
After power up
1
ms
Timing requirements over recommended ranges of supply
voltage and operating free-air temperature
Note: Time required for the PLL circuit to obtain phase lock of its feedback signal to its reference
In order for phase lock to be obtained, a fixed-frequency, fixed-phase reference signal must be
Until phase lock is obtained, the specifications for parameters given in the switching characteristics table are not
Electrical Characteristics - Input & Supply
TA = 0 - 70C; Supply Voltage VDD = 3.3 V +/-10% (unless otherwise stated)
PARAMETER
SYMBOL
CONDITIONS
MIN
TYP
MAX
UNITS
Input High Voltage
VIH
2VDD+0.3
V
Input Low Voltage
VIL
VSS-0.3
0.8
V
Input High Current
IIH
VIN = VDD
0.1
100
uA
Input Low Current
IIL
VIN = 0 V;
19
50
uA
Operating current
IDD1
CL = 0 pF; FIN @ 66M
140
170
mA
Input Capacitance
CIN
1
Logic Inputs
4
pF
Output Capacitance
CO
1
Logic Outputs
8
pF
1Guarenteed by design, not 100% tested in production.
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PDF描述
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