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参数资料
| 型号： | ICS270PGILF |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 8/11页 |
| 文件大小： | 0K |
| 描述： | VCXO CLK TRPL PLL PROGR 20-TSSOP |
| 标准包装： | 74 |
| 系列： | VersaClock™ |
| 类型： | 时钟/频率合成器，扇出缓冲器（分配） |
| PLL： | 带旁路 |
| 输入： | 晶体 |
| 输出： | CMOS |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:8 |
| 差分 - 输入:输出： | 无/无 |
| 频率 - 最大： | 200MHz |
| 除法器/乘法器： | 是/是 |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 20-TSSOP（0.173"，4.40mm 宽） |
| 供应商设备封装： | 20-TSSOP |
| 包装： | 管件 |
| 其它名称： | 270PGILF |
ICS270
TRIPLE PLL FIELD PROGRAMMABLE VCXO CLOCK
EPROM VCXO AND SYNTHESIZER
IDT / ICS TRIPLE PLL FIELD PROGRAMMABLE VCXO CLOCK
6
ICS270
REV F 051310
DC Electrical Characteristics
Unless stated otherwise, VDD = 3.3 V ±5%, Ambient Temperature -40 to +85
° C
Note 1: Example with 25 MHz crystal input with eight outputs of 33.3 MHz, no load, and VDD = 3.3 V.
Parameter
Symbol
Conditions
Min.
Typ.
Max.
Units
Operating Voltage
VDD
3.135
3.465
V
Operating Supply Current
Input High Voltage
IDD
Config. Dependent - See
VersaClockTM Estimates
mA
Eight 33.3333 MHz outs,
PDTS = 1, no load, Note 1
27
mA
PDTS = 0, no load, Note 1
500
A
Input High Voltage
VIH
S2:S0
VDD/2+1
V
Input Low Voltage
VIL
S2:S0
0.4
V
Input High Voltage, PDTS
VIH
VDD-0.5
V
Input Low Voltage, PDTS
VIL
0.4
V
Input High Voltage
VIH
ICLK
VDD/2+1
V
Input Low Voltage
VIL
ICLK
VDD/2-1
V
Output High Voltage
(CMOS High)
VOH
IOH = -4 mA
VDD-0.4
V
Output High Voltage
VOH
IOH = -8 mA (Low Drive);
IOH = -12 mA (High Drive)
2.4
V
Output Low Voltage
VOL
IOL = 8 mA (Low Drive);
IOL = 12 mA (High Drive)
0.4
V
Short Circuit Current
IOS
Low Drive
±40
mA
High Drive
±70
Nom. Output Impedance
ZO
20
Internal Pull-up Resistor
RPUS
S2:S0, PDTS
190
k
Internal Pull-down Resistor
RPD
CLK outputs
220
k
Input Capacitance
CIN
Inputs
4
pF
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PDF描述 |
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