参数资料
型号: ICS333M-XX-LF
元件分类: 时钟产生/分配
英文描述: 200 MHz, OTHER CLOCK GENERATOR, PDSO8
封装: 0.150 INCH, SOIC-8
文件页数: 2/6页
文件大小: 72K
代理商: ICS333M-XX-LF
QTClock Triple Output Clock
MDS 333 D
2
Revision 020102
Integrated Circuit Systems, Inc. q 525 Race Street, San Jose, CA 95126 q tel (408) 295-9800 q
www.icst.com
ICS333
Pin Assignment
8 pin (150 mil) SOIC
Output Clock Selection Table
Note: The output clock frequencies and spread amount
are determined when the device is programmed.
Pin Descriptions
X1 / C L K
VD D
GND
PD TS
CL K 1
CL K 3
CL K 2
X2
1
2
3
4
8
7
6
5
CLK1
CLK2
CLK3
Output frequency
TBD (MHz)
Spread amount
TBD (%)
Spread direction
TBD
Pin
Pin Description
1X1/CLK
XI
Crystal Input. Connect this pin to a 5 to 27 MHz fundamental crystal or clock
input.
2
VDD
Power
Connect to +3.3V.
3
GND
Power
Connect to ground.
4
CLK1
Output
CMOS level clock output. Weak internal pull-down when tri-state.
5
CLK2
Output
CMOS level clock output. Weak internal pull-down when tri-state.
6
CLK3
Output
CMOS level clock output. Weak internal pull-down when tri-state.
7
PDTS
Input
Powers down entire chip. Tri-states CLK outputs when low. Internal pull-up.
8X2
XO
Crystal Input. Connect this pin to a 5 to 27 MHz fundamental crystal. Float for
clock input.
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