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参数资料
| 型号： | ICS527R-01ILFT |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 7/11页 |
| 文件大小： | 0K |
| 描述： | IC CLOCK SLICER ZD BUFFER 28SSOP |
| 产品培训模块： | Clock Distibution and Generation 1.0 |
| 标准包装： | 2,500 |
| 类型： | 扇出缓冲器（分配），零延迟缓冲 |
| PLL： | 是 |
| 输入： | 时钟 |
| 输出： | 时钟 |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:2 |
| 差分 - 输入:输出： | 无/无 |
| 频率 - 最大： | 140MHz |
| 除法器/乘法器： | 是/是 |
| 电源电压： | 3 V ~ 3.6 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 28-SSOP（0.154"，3.90mm 宽） |
| 供应商设备封装： | 28-QSOP |
| 包装： | 带卷 (TR) |
| 其它名称： | 527R-01ILFT |
ICS527-01
CLOCK SLICER USER CONFIGURABLE ZERO DELAY BUFFER
ZDB AND MULTIPLIER/DIVIDER
IDT / ICS CLOCK SLICER USER CONFIGURABLE ZERO DELAY BUFFER 5
ICS527-01
REV G 051310
Typical Example
The following connection diagram shows the implementation of the example from the previous section.
This will generate a 50 MHz clock synchronously with a 40 MHz input. A SYNC pulse is desired and the 1x
output drive is selected.T
Note: The series termination resistor is located before the feedback trace.
This will give the following waveforms:
Multiple Output Example
In this example, an input clock of 125 MHz is used. Eight copies of 50 MHz are required as are eight copies
of 25 MHz, de-skewed and aligned to the 125 MHz input clock. The following solution uses the
MK74CB218 which has dual 1 to 8 buffers with low pin-to-pin skew.
F6
ICLK
F5
F4
GND
F3
OECLK2
2XDRIVE
F0
F1
F2
CLK1
CLK2
GND
S1
VDD
R0
VDD
DIV2
S0
R2
R1
R5
R6
R4
R3
FBIN
PDTS
50 MHz
SYNC
33
0.01 F
40 MHz
0.01 F
VDD
40 MHz
ICLK
50 MHz
CLK1
SYNC
CLK2
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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