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参数资料
| 型号： | ICS548AM-03LF |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 5/7页 |
| 文件大小： | 0K |
| 描述： | IC CLK INVERTER/DIVIDER 16-SOIC |
| 标准包装： | 48 |
| 类型： | 时钟/频率合成器，时钟发生器，扇出配送 |
| PLL： | 是 |
| 输入： | LVTTL，晶体 |
| 输出： | PECL，SSTL-3 |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:4 |
| 差分 - 输入:输出： | 无/是 |
| 频率 - 最大： | 250MHz |
| 除法器/乘法器： | 是/无 |
| 电源电压： | 3 V ~ 3.6 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 16-SOIC（0.154"，3.90mm 宽） |
| 供应商设备封装： | 16-SOIC |
| 包装： | 管件 |
| 其它名称： | 548AM-03LF |
ICS548A-03
LOW SKEW CLOCK INVERTER AND DIVIDER
CLOCK DIVIDER
IDT / ICS LOW SKEW CLOCK INVERTER AND DIVIDER
5
ICS548A-03
REV C 063006
AC Electrical Characteristics
VDD = 3.3 V, Ambient Temperature -40 to +85
° C, unless stated otherwise
Note 1: The phase relationship between input and output clocks can change at power up. Use the ICS570 or
ICS527 Zero Delay Buffers for a guaranteed phase relationship.
Thermal Characteristics
Parameter
Symbol
Conditions
Min.
Typ.
Max.
Units
Input Frequency, clock
input, PLL on
fIN
10
120
MHz
Input Frequency, clock
input, PLL off
fIN
0160
MHz
Output Frequency (see
table on page 2)
fOUT
Mode dependent
0
120
MHz
Output Clock Rise Time
tOR
0.8 to 2.0 V
0.84
ns
Output Clock Fall Time
tOF
2.0 to 0.8 V
0.74
ns
Output Clock Duty Cycle
tDC
At VDD/2
45
50
55
%
Output Enable Time, OE
high to output on
50
ns
Output Disable Time, OE
to tri-state
50
ns
Absolute Clock Period
Jitter. PLL modes
Deviation from mean
150
ps
One Sigma Clock Period
Jitter, PLL modes
60
ps
Output clock skew for
CLK, CLK, or CLK/2
At VDD/2
850
ps
Parameter
Symbol
Conditions
Min.
Typ.
Max.
Units
Thermal Resistance Junction to
Ambient
θJA
Still air
120
° C/W
θJA
1 m/s air flow
115
° C/W
θJA
3 m/s air flow
105
° C/W
Thermal Resistance Junction to Case
θJC
58
° C/W
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