参数资料
型号: ICS570ALF
元件分类: 时钟及定时
英文描述: 570 SERIES, PLL BASED CLOCK DRIVER, 2 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO8
封装: 0.150 INCH, LEAD FREE, SOIC-8
文件页数: 2/9页
文件大小: 199K
代理商: ICS570ALF
Multiplier and Zero Delay Buffer
MDS 570 I
2
Revision 030905
Integrated Circuit Systems, Inc.
525 Race Street, San Jose, CA 95126 tel (408) 297-1201 www.icst.com
ICS570
Pin Assignment
Clock Multiplier Decoding Table
(Multiplies Input clock by amount shown)
0 = connect directly to ground
M = leave unconnected (self-biases to VDD/2)
1 = connect directly to VDD
*Input range with CLK feedback is double that for CLK/2
Pin Descriptions
S1
VDD
GND
CLK
ICLK
S0
FBIN
CLK/2
1
2
3
4
8
7
6
5
S1
VDD
GND
CLK
ICLK
S0
FBIN
CLK/2
1
2
3
4
8
7
6
5
8 pin (150 mil) SOIC
S1
S0
FBIN from CLK
FBIN from CLK/2
ICS570B (3.3 V)
ICS570A (5.0 V)
CLK
CLK2
CLK
CLK2
ICLK Input Range FB from CLK/2*
#1
#6
pin #7
pin #8
pin #7
pin #8
0
Power Down and Tri-State
-
0
M
x3
x1.5
x6
x3
3.75 to 28
2.5 to 25
0
1
x4
x2
x8
x4
2.75 to 19
2.5 to 19
M
0
x8
x4
x16
x8
2.5 to 9.5
M
x6
x3
x12
x6
2.5 to 12.5
M
1
x10
x5
x20
x10
2.5 to 7.5
1
0
x1
/2
x2
x1
11 to 75
5 to 75
1
M
x16
x8
x32
x16
2.5 to 5
1
x2
x1
x4
x2
5.5 to 37.5
2.5 to 37.5
Pin
Number
Pin
Name
Pin
Type
Pin Description
1
S1
Input
Select 1 for output clock. Connect to GND, VDD, or float per decoding table above.
2
VDD
Power
Connect to +3.3 V (ICS570B). Connect to +5.0 V (ICS570A).
3
GND
Power
Connect to ground.
4
ICLK
Input
Reference clock input.
5
FBIN
Input
Feedback clock input.
6
S0
Input
Select 0 for output clock. Connect to GND, VDD, or float per decoding table above.
7
CLK
Output
Clock output per table above.
8
CLK/2
Output
Clock output per table above. Low skew divide by two of pin 7 clock.
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PDF描述
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