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参数资料
| 型号： | ICS571MLF |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 2/7页 |
| 文件大小： | 0K |
| 描述： | IC ZDB LOW PHASE NOISE 8-SOIC |
| 标准包装： | 97 |
| 系列： | ClockBlocks™ |
| 类型： | 扇出缓冲器（分配），零延迟缓冲 |
| PLL： | 是 |
| 输入： | CMOS |
| 输出： | CMOS |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:2 |
| 差分 - 输入:输出： | 无/无 |
| 频率 - 最大： | 160MHz |
| 除法器/乘法器： | 是/是 |
| 电源电压： | 3 V ~ 5.5 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 8-SOIC（0.154"，3.90mm 宽） |
| 供应商设备封装： | 8-SOIC |
| 包装： | 管件 |
| 产品目录页面： | 1252 (CN2011-ZH PDF) |
| 其它名称： | 571MLF 800-1074 800-1074-5 800-1074-ND |
ICS571
LOW PHASE NOISE ZERO DELAY BUFFER
ZDB AND MULTIPLIER/DIVIDER
IDT / ICS LOW PHASE NOISE ZERO DELAY BUFFER
2
ICS571
REV H 051310
Pin Assignment
Feedback Configuration Table and Frequency Ranges (at 3.3 V)
Pin Descriptions
Key: CI = clock input; I = input; O = output; P = power supply connection.
Feedback From
CLK
CLK/2
Input Range
CLK
Input clock frequency
Input clock frequency/2
20 to 160 MHz
CLK/2
2x Input clock frequency
Input clock frequency
10 to 80 MHz
Pin
Number
Pin
Name
Pin
Type
Pin Description
1
ICLK
CI
Reference clock input.
2
VDD
P
Connect to +3.3 V or +5 V. Must be same as other VDD.
3
GND
P
Connect to ground.
4
CLK/2
O
Clock output per table above. Low skew divide by two of pin 7 clock.
5
GND
P
Connect to ground.
6
VDD
P
Connect to +3.3 V or +5 V. Must be same as other VDD.
7
CLK
O
Clock output per table above.
8
FBIN
CI
Feedback clock input. Connect to CLK or CLK/2 per table above.
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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