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参数资料
| 型号： | ICS580M-01 |
| 元件分类： | 时钟及定时 |
| 英文描述： | 580 SERIES, LOW SKEW CLOCK DRIVER, 2 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO16 |
| 封装： | 0.150 INCH, SOIC-16 |
| 文件页数： | 3/8页 |
| 文件大小： | 152K |
| 代理商： | ICS580M-01 |
Glitch-Free Clock Multiplexer
MDS 580-01 E
3
Revision 080305
Integrated Circuit Systems, Inc.
● 525 Race Street, San Jose, CA 95126 ● tel (408) 297-1201 ● www.icst.com
ICS580-01
Device Operation
The ICS580-01 consists of a glitch free mux between INA and INB controlled by SELB. The device is
designed to switch between two clocks, whether running or not. In the first example, clocks are running on
both INA and INB. When SELB changes, the output clock goes low after three cycles of the output clock
(nominally). The output then stays low for three cycles of the new input clock (nominally) and then starts
with the new input clock. This is shown in Figure 1.
In the second example, one of the inputs was selected and running but has since stopped (either high or
low). This is indicated by either NO_INA or NO_INB going high depending on whether INA or INB has
stopped. These signals go high following a selectable time-out period after the clock has stopped. The
timeout period is determined by the DIV input in. The SELB pin is now changed to select the new input
clock which is running. The output clock immediately goes low and stays low for three cycles of the new
input clock and then starts with the new input clock. Figure 2 shows an example of this
INA
INB
SELB
CLK1, 2
Figure 1
INA
INB
SELB
NO_INA
Figure 2
Timeout
CLK1, 2
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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