参数资料
型号: ICS581G-01ILF
厂商: INTEGRATED DEVICE TECHNOLOGY INC
元件分类: 时钟及定时
英文描述: 581 SERIES, PLL BASED CLOCK DRIVER, 4 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO16
封装: 4.40 MM, 0.65 MM PITCH, MO-153, TSSOP-16
文件页数: 1/9页
文件大小: 167K
代理商: ICS581G-01ILF
ICS581-01/02
MDS 581-01/02 H
1
Revision 050206
Integrated Circuit Systems, Inc.
525 Race Street, San Jose, CA 95126 tel (408) 297-1201 www.icst.com
Zero Delay Glitch-Free Clock Multiplexer
Description
The ICS581-01 and ICS581-02 are glitch free, Phase
Locked Loop (PLL) based clock multiplexers (mux) with
zero delay from input to output. They each have four
low skew outputs which can be configured as a single
output, three outputs, or four outputs. The ICS581-01
allows user control over the mux switching, while the
ICS581-02 has automatic switching between the two
clock inputs.
The ICS581-01 and -02 are members of ICS’
ClockBlocksTM family of clock generation,
synchronization, and distribution devices. For a
non-PLL based clock mux, see the ICS580-01.
Features
16-pin TSSOP package
RoHS compliant packaging available
No short pulses or glitches on output
Operates from 6 to 200 MHz
Low skew outputs
User controlled (-01) or automatic, timed mux switch
(-02)
Ideal for systems with back-up or redundant clocks
Zero delay (input to output)
50% output duty cycle allows duty cycle correction
SpreadSmartTM technology works with spread
spectrum parts
Industrial temperature of ICS581-02 available
Block Diagram
PLL
GND
1
0
INA
INB
CLK1
VDD
SELA
Output
Divide
2
S1:0
CLK2
CLK3
CLK4
OE1
FBIN
OE0
2
ICS581-01
PLL
GND
INA
INB
CLK1
VDD
Output
Divide
2
S1:0
CLK2
CLK3
CLK4
OE1
FBIN
OE0
2
1
0
Transition
Detector
1
0
/3
/48
DIV
IN
ICS581-02
相关PDF资料
PDF描述
ICS581G-02I 581 SERIES, PLL BASED CLOCK DRIVER, 4 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO16
ICS601M-02IT 170 MHz, OTHER CLOCK GENERATOR, PDSO16
ICS650R-01ILF 80 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO20
ICS650R-01LF 80 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO20
ICS650R-01T 80 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO20
相关代理商/技术参数
参数描述
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