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参数资料
| 型号： | ICS601R-25LF |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | 时钟产生/分配 |
| 英文描述： | 156 MHz, OTHER CLOCK GENERATOR, PDSO20 |
| 封装： | 0.150 INCH, ROHS COMPLIANT, SSOP-20 |
| 文件页数： | 4/6页 |
| 文件大小： | 212K |
| 代理商： | ICS601R-25LF |
LOW PHASE NOISE 1 TO 5 CLOCK MULTIPLIER
MDS 601-25 C
4
Revision 071505
In te gr ated Circuit Systems ● 525 Ra ce Street, San Jose, CA 9512 6 ● tel (4 08) 297-1 201 ● www.icst.com
ICS601-25
DC Electrical Characteristics (continued)
AC Electrical Characteristics
VDD = 3.3V ±10%, Ambient Temperature -40 to +85° C
Note 1: Measured with 15 pF load
Parameter
Symbol
Conditions
Min.
Typ.
Max.
Units
Input High Voltage
VIH
2VDD
V
Input Low Voltage
VIL
0.8
V
Output High Voltage, CMOS
level
VOH
IOH = -4 mA
VDD-0.4
V
Output High Voltage
VOH
IOL = -12 mA
2.4
V
Output Low Voltage
VOL
IOL = 12 mA
0.4
V
Operating Supply Current
IDD
No load, 125 MHz
45
60
mA
Short Circuit Current
IOS
Each output
± 40
± 60
mA
Input Capacitance
Select pins
5
pF
Output Impedance
ZOUT
20
On Chip Pull-up Resistor
RPU
S2, S1, S0, PD
pins
510
k
On Chip Pull-down Resistor
RPD
S3 pin
240
k
Parameter
Symbol
Conditions
Min.
Typ.
Max.
Units
Input Frequency
10
27
MHz
Output Frequency
At 3.3V
156
MHz
Output Rise Time
tOR
0.8 to 2.0 V, Note 1
1.5
ns
Output Fall Time
tOF
0.8 to 2.0 V, Note 1
1.5
ns
Output Clock Duty Cycle
At VDD/2, Note 1
45
50
55
%
Maximum Absolute jitter, short
term, 125 MHz
Note 1
±50
±75
ps
Maximum jitter, one sigma, 125
MHz (x5)
Note 1
18
25
ps
Phase Noise, relative to carrier,
125 MHz (x5)
100 Hz offset
-90
-95
dBc/Hz
Phase Noise, relative to carrier,
125 MHz (x5)
1 kHz
-115
-120
dBc/Hz
Phase Noise, relative to carrier,
125 MHz (x5)
10 kHz offset
-118
-123
dBc/Hz
Phase Noise, relative to carrier,
125 MHz (x5)
100 kHz offset
-115
-120
dBc/Hz
Output to Output Skew
25M in, 125M out,
Note 1
250
ps
ICS601-25
LOW PHASE NOISE 1 TO 5 CLOCK MULTIPLIER
TSD
IDT / ICS LOW PHASE NOISE 1 TO 5 CLOCK MULTIPLIER
ICS601-25
4
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