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参数资料
| 型号： | ICS650R-14T |
| 元件分类： | XO, clock |
| 英文描述： | 133.33 MHz, OTHER CLOCK GENERATOR, PDSO20 |
| 封装： | 0.150 INCH, SSOP-20 |
| 文件页数： | 1/6页 |
| 文件大小： | 139K |
| 代理商： | ICS650R-14T |
ICS650-14
MDS 650-14 E
1
Revision 092104
Integrated Circuit Systems, Inc.
● 525 Race Street, San Jose, CA 95126 ● tel (408) 297-1201 ● www.icst.com
Networking System Clock
Description
The ICS650-14 is a low-cost, low-jitter,
high-performance clock synthesizer customized for
networking systems applications. Using analog/digital
Phase-Locked Loop (PLL) techniques, the device
accepts a 25 MHz clock or fundamental mode crystal
input to produce multiple output clocks of one fixed 25
MHz, a four (plus one) frequency selectable bank, and
two frequency selectable clocks. All output clocks are
frequency locked together. All of the ICS650-14 outputs
have zero ppm synthesis error.
Features
Packaged in 20-pin (150 mil) SSOP (QSOP)
25 MHz fundamental crystal clock or clock input
One fixed output clock of 25 MHz
One bank of four frequency selectable output clocks
Three frequency selectable clocks outputs
Zero ppm synthesis error in all clocks
Ideal for networking systems
Full CMOS output swing
Advanced, low-power sub-micron CMOS process
Operating voltage of 3.3 V or 5 V
Industrial temperature range available
Block Diagram
Clock
S ynthesis and
C ontrol
Circuitry
CLK B
C LKA 1:4
25 M H z
C rystal or C lock
C LKA5
CLKC
4
O E (all outputs)
25 M H z
C rystal
Buffer/
C rystal
O scillator
X1/ICLK
X2
SE LA 0:1
S E LB 0:1
SE LC
VD D
2
GN D
2
O ptional crystal capacitors are show n and m ay be
required for tuning of initial accuracy (determ ined
once per board)
2
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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