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参数资料
| 型号： | ICS680G-01LF |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 2/9页 |
| 文件大小： | 0K |
| 描述： | IC SYNTHESIZER/ZD BUFFER 24TSSOP |
| 标准包装： | 62 |
| 类型： | 时钟/频率合成器，零延迟缓冲器 |
| PLL： | 是 |
| 输入： | 时钟，晶体 |
| 输出： | CMOS |
| 电路数： | 2 |
| 比率 - 输入:输出： | 1:4 |
| 差分 - 输入:输出： | 无/无 |
| 频率 - 最大： | 66.67MHz |
| 除法器/乘法器： | 是/无 |
| 电源电压： | 3.13 V ~ 3.46 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 24-TSSOP（0.173"，4.40mm 宽） |
| 供应商设备封装： | 24-TSSOP |
| 包装： | 管件 |
| 其它名称： | 680G-01LF |
ICS680-01
NETWORKING CLOCK SYNTHESIZER AND ZERO DELAY BUFFER
ZDB AND SYNTHESIZER
IDT / ICS NETWORKING CLOCK SYNTHESIZER AND ZERO DELAY BUFFER 2
ICS680-01
REV H 051310
Pin Assignment
Output Clock Select Table
Pin Descriptions
13
4
5
CLK1
8
9
10
25M
Q1
QFB
48M
Q2
VDD
17
16
VDD
3
S0
VDD
S1
18
PDTS
1
X1/ICLK
GND
VDD
20
X2
19
14
2
7
GND
ICLK
VDD
15
6
24-pin TSSOP
11
12
GND
Q3
CLK2
Q4
21
22
23
24
S0
S1
CLK1 (MHz)
CLK2 (MHz)
MM
OFF
48
0
50
48
0
1
66.6666
48
1
0
50
24
1
66.6666
24
Pin
Number
Pin
Name
Pin
Type
Pin Description
1
X1/ICLK
XI
Crystal input. Connect this pin to a crystal or external clock source.
2
GND
Power
Connect to ground.
3
S0
Input
Select pin 0. See table above.
4
VDD
Power
Connect to voltage supply.
5
CLK1
Output
Selectable output clock. See table above. Weak internal pull-down when
tri-state.
6
GND
Power
Connect to ground.
7
GND
Power
Connect to ground.
8
Q1
Output
Clock output 1. Weak internal pull-down when tri-state.
9
Q2
Output
Clock output 2. Weak internal pull-down when tri-state.
10
VDD
Power
Connect to voltage supply.
11
Q3
Output
Clock output 3. Weak internal pull-down when tri-state.
12
Q4
Output
Clock output 4. Weak internal pull-down when tri-state.
13
GND
Power
Connect to ground.
14
CLK2
Output
Selectable output clock. See table above. Weak internal pull-down when
tri-state.
15
48M
Output
48 MHz output clock. Weak internal pull-down when tri-state.
16
VDD
Power
Connect to voltage supply.
17
QFB
Output
Feedback pin. Internally connected.
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PDF描述 |
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参数描述 |
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