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参数资料
| 型号： | ICS813076CYILF |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 18/23页 |
| 文件大小： | 0K |
| 描述： | IC VCXO-PLL WIRELESS 64-TQFP |
| 标准包装： | 160 |
| 系列： | HiPerClockS™, FemtoClock™ |
| 类型： | 时钟/频率发生器，扇出缓冲器（分配），抖动衰减器，多路复用器 |
| PLL： | 是 |
| 主要目的： | 无线基础架构应用 |
| 输入： | HCSL，LVDS，LVHSTL，LVPECL，SSTL，晶体 |
| 输出： | LVPECL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 3:9 |
| 差分 - 输入:输出： | 是/是 |
| 频率 - 最大： | 614.4MHz |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 64-TQFP 裸露焊盘 |
| 供应商设备封装： | 64-TQFP-EP（10x10） |
| 包装： | 托盘 |
| 其它名称： | 813076CYILF |
IDT / ICS FREQUENCY GENERATOR/JITTER ATTENUATION
4
ICS813076CYI REV. A JULY 8, 2008
ICS813076I
FREQUENCY GENERATOR/JITTER ATTENUATION FOR WIRELESS INFRASTRUCTURE
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TABLE 3A. FREQUENCY CONFIGURATION EXAMPLES TABLE (f
VCXO = 30.72MH
Z
)
DEVICE CONFIGURATION
The ICS813076I is a two stage device, a VCXO PLL stage
followed by a low phase noise FemtoClock PLL multiplier stage.
The VCXO PLL stage uses a pullable crystal to lock to the
reference clock. The low phase noise FemtoClock multiplies
the VCXO PLL output clock up to 614.4MHz and three
independent output dividers scale the frequency down to the
desired output frequencies. With a given input and VCXO
frequency, the output frequency is a function of the P, MV, MF
and NA, NB, NC dividers, and can be set by pulling configuration
pins high or low. See “ICS813076I Examples Frequency Con-
figuration (f
VCXO= 30.72MHz)” for typical device configurations.
Note that for correct operation, the input frequency times the
MV-divider must be 30.72MHz ± 50ppm. The ICS813076I
supports up to three output frequencies f
OUT independently.
30.72MH z
XTALIN
XTALOUT
30.72MHz
VCXO
MV = 1
P = 1
FemtoClock PLL
VCO = 614.4MHz
MF = 20
N = 4
153.6MHz
Qn
CLK
ICS813076I
FIGURE 1. APPLICATION EXAMPLE (153.6MHZ CLOCK GENERATION AND JITTER ATTENUATION)
TABLE 2. PIN CHARACTERISTICS
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