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参数资料
| 型号： | ICS843004AGI-01LFT |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 12/19页 |
| 文件大小： | 0K |
| 描述： | IC SYNTHESIZER LVPECL 24-TSSOP |
| 标准包装： | 2,500 |
| 系列： | HiPerClockS™, FemtoClock™ |
| 类型： | 频率合成器 |
| PLL： | 带旁路 |
| 输入： | 晶体 |
| 输出： | LVPECL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:4 |
| 差分 - 输入:输出： | 无/是 |
| 频率 - 最大： | 170MHz |
| 除法器/乘法器： | 是/无 |
| 电源电压： | 2.375 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 24-TSSOP（0.173"，4.40mm 宽） |
| 供应商设备封装： | 24-TSSOP |
| 包装： | 带卷 (TR) |
| 其它名称： | 843004AGI-01LFT |
ICS843004AGI-01 REVISION B MARCH 24, 2011
2
2011Integrated Device Technology, Inc.
ICS843004I-01 Data Sheet
FEMTOCLOCK CRYSTAL-TO-3.3V, 2.5V LVPECL FREQUENCY SYNTHESIZER
Table 1. Pin Descriptions
NOTE: Pulldown refers to internal input resistors. See Table 2, Pin Characteristics, for typical values.
Table 2. Pin Characteristics
Number
Name
Type
Description
1, 2
nQ1, Q1
Output
Differential output pair. LVPECL interface levels.
3, 22
VCCO
Power
Output supply pins.
4, 5
Q0, nQ0
Output
Differential output pair. LVPECL interface levels.
6
MR
Input
Pulldown
Active HIGH Master Reset. When logic HIGH, the internal dividers are reset causing
the true outputs Qx to go low and the inverted outputs nQx to go high. When logic
LOW, the internal dividers and the outputs are enabled. LVCMOS/LVTTL interface
levels.
7
nPLL_SEL
Input
Pulldown
Selects either the PLL or the active input reference to be routed to the output
dividers. When LOW, selects PLL (PLL Enable). When HIGH, selects the reference
clock (PLL Bypass). LVCMOS/LVTTL interface levels.
8
nc
Unused
No connect.
9VCCA
Power
Analog supply pin.
10,
12
F_SEL0,
F_SEL1
Input
Pulldown
Frequency select pins. LVCMOS/LVTTL interface levels.
11, 18
VCC
Power
Core supply pins.
13,
14
XTAL_OUT,
XTAL_IN
Input
Parallel resonant crystal interface. XTAL_OUT is the output, XTAL_IN is the input.
15, 19
VEE
Power
Negative supply pins.
16
TEST_CLK
Input
Pulldown
Single-ended clock input. LVCMOS/LVTTL interface levels.
17
nXTAL_SEL
Input
Pulldown
Selects between the single-ended TEST_CLK or crystal interface as the PLL
reference source. When HIGH, selects TEST_CLK. When LOW, selects XTAL
inputs. LVCMOS/LVTTL interface levels.
20, 21
nQ3, Q3
Output
Differential output pair. LVPECL interface levels.
23, 24
Q2, nQ2
Output
Differential output pair. LVPECL interface levels.
Symbol
Parameter
Test Conditions
Minimum
Typical
Maximum
Units
CIN
Input Capacitance
4pF
RPULLDOWN Input Pulldown Resistor
51
k
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