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参数资料
| 型号： | ICS843023AGLF |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 2/14页 |
| 文件大小： | 0K |
| 描述： | IC CLK GENERATOR LVPECL 8-TSSOP |
| 标准包装： | 96 |
| 系列： | HiPerClockS™, FemtoClock™ |
| 类型： | 时钟/频率合成器，时钟发生器 |
| PLL： | 是 |
| 输入： | 晶体 |
| 输出： | LVPECL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:1 |
| 差分 - 输入:输出： | 无/是 |
| 频率 - 最大： | 320MHz |
| 除法器/乘法器： | 是/无 |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 8-TSSOP（0.173"，4.40mm 宽） |
| 供应商设备封装： | 8-TSSOP |
| 包装： | 管件 |
| 其它名称： | 843023AGLF |
10
DS563F2
CS5381
SWITCHING CHARACTERISTICS - SERIAL AUDIO PORT
(Logic “0” = GND = 0 V; Logic “1” = VL, CL = 20 pF)
Parameter
Symbol
Min
Typ
Max
Unit
Output Sample Rate
Single-Speed Mode
Double-Speed Mode
Quad-Speed Mode
Fs
2
50
100
-
54
108
216
kHz
OVFL to LRCK Edge Setup Time
tsetup
16/fsclk
--
s
OVFL to LRCK Edge Hold Time
thold
1/fsclk
--
s
OVFL time-out on overrange condition
Fs = 44.1, 88.2, 176.4 kHz
Fs = 48, 96, 192 kHz
-
740
680
-
ms
MCLK Specifications
MCLK Period
tclkw
36
-
1953
ns
MCLK Duty Cycle
40
-
60
%
Master Mode
SCLK falling to LRCK transition
tmslr
-20
-
20
ns
SCLK falling to SDOUT valid
tsdo
-
32
ns
SCLK Duty Cycle
-50
-
%
Slave Mode
Single-Speed
Output Sample Rate
Fs
2
-
54
kHz
LRCK Duty Cycle
40
50
60
%
SCLK Period
tsclkw
145
-
ns
SCLK Duty Cycle
45
50
55
%
SDOUT valid before SCLK rising
tstp
10
-
ns
SDOUT valid after SCLK rising
thld
5-
-
ns
SCLK falling to LRCK transition
tslrd
-20
-
20
ns
Double-Speed
Output Sample Rate
Fs
50
-
108
kHz
LRCK Duty Cycle
40
50
60
%
SCLK Period
tsclkw
145
-
ns
SCLK Duty Cycle
45
50
55
%
SDOUT valid before SCLK rising
tstp
10
-
ns
SDOUT valid after SCLK rising
thld
5-
-
ns
SCLK falling to LRCK transition
tslrd
-20
-
20
ns
Quad-Speed
Output Sample Rate
Fs
100
-
216
kHz
LRCK Duty Cycle
40
50
60
%
SCLK Period
tsclkw
72
-
ns
SCLK Duty Cycle
45
50
55
%
SDOUT valid before SCLK rising
tstp
10
-
ns
SDOUT valid after SCLK rising
thld
5-
-
ns
SCLK falling to LRCK transition
tslrd
-8
-
8
ns
相关PDF资料 |
PDF描述 |
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参数描述 |
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