参数资料
型号: ICS8430AY-61LF
厂商: IDT, Integrated Device Technology Inc
文件页数: 3/21页
文件大小: 0K
描述: IC SYNTHESIZR DUAL LVPECL 32LQFP
标准包装: 250
系列: HiPerClockS™
类型: 频率合成器
PLL: 带旁路
输入: 晶体
输出: LVPECL
电路数: 1
比率 - 输入:输出: 1:2
差分 - 输入:输出: 无/是
频率 - 最大: 500MHz
除法器/乘法器: 是/无
电源电压: 3.135 V ~ 3.465 V
工作温度: 0°C ~ 70°C
安装类型: 表面贴装
封装/外壳: 32-LQFP
供应商设备封装: 32-TQFP(7x7)
包装: 托盘
产品目录页面: 1249 (CN2011-ZH PDF)
其它名称: 800-1137
8430AY-61LF
8430AY-61
www.idt.com
REV. D JULY 27, 2010
11
ICS8430-61
500MHZ, CRYSTAL-TO-3.3V, 2.5V DIFFERENTIAL
LVPECL FREQUENCY SYNTHESIZER
3.3V
125
Ω
125
Ω
84
Ω
84
Ω
Z
o = 50Ω
Z
o = 50Ω
FOUT
FIN
V
CC - 2V
50
Ω
50
Ω
RTT
Z
o = 50Ω
Z
o = 50Ω
FOUT
FIN
RTT =
Z
o
1
((V
OH + VOL) / (VCC – 2)) – 2
The clock layout topology shown below is a typical termina-
tion for LVPECL outputs. The two different layouts mentioned
are recommended only as guidelines.
FOUT and nFOUT are low impedance follower outputs that
generate ECL/LVPECL compatible outputs. Therefore, termi-
nating resistors (DC current path to ground) or current sources
must be used for functionality. These outputs are designed to
drive 50
Ω transmission lines. Matched impedance tech-
FIGURE 5B. LVPECL OUTPUT TERMINATION
FIGURE 5A. LVPECL OUTPUT TERMINATION
niques should be used to maximize operating frequency
and minimize signal distortion. There are a few simple ter-
mination schemes.
Figures 5A and 5B show two different
layouts which are recommended only as guidelines. Other
suitable clock layouts may exist and it would be recom-
mended that the board designers simulate to guarantee
compatibility across all printed circuit and clock component
process variations.
TERMINATION FOR 3.3V LVPECL OUTPUTS
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