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参数资料
| 型号： | ICS844021AG-01LF |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | 时钟产生/分配 |
| 英文描述： | 170 MHz, OTHER CLOCK GENERATOR, PDSO8 |
| 封装： | 4.40 X 3 MM, 0.925 MM HEIGHT, ROHS COMPLIANT, MO-153, TSSOP-8 |
| 文件页数： | 8/11页 |
| 文件大小： | 2541K |
| 代理商： | ICS844021AG-01LF |
IDT / ICS LVDS CLOCK GENERATOR
6
ICS844021AG-01 REV A OCTOBER 30, 2006
ICS844021-01
FEMTOCLOCKS CRYSTAL-TO-LVDS CLOCK GENERATOR
PRELIMINARY
APPLICATION INFORMATION
FIGURE 2. CRYSTAL INPUt INTERFACE
CRYSTAL INPUT INTERFACE
The ICS844021-01 has been characterized with 18pF parallel
resonant crystals. The capacitor values, C1 and C2, shown in
Figure 2 below were determined using a 25MHz, 18pF parallel
resonant crystal and were chosen to minimize the ppm error.
The optimum C1 and C2 values can be slightly adjusted for
different board layouts.
C1
33p
X1
18pF Parallel Crystal
C2
27p
XTAL_OUT
XTAL_IN
POWER SUPPLY FILTERING TECHNIQUES
As in any high speed analog circuitry, the power supply pins
are vulnerable to random noise. The ICS844021-01 provides
separate power supplies to isolate any high switching
noise from the outputs to the internal PLL. V
DD and VDDA should
be individually connected to the power supply plane through
vias, and bypass capacitors should be used for each pin.
To achieve optimum jitter performance, power supply isolation
is required.
Figure 1 illustrates how a 10
resistor along with
a 10
F and a .01F bypass capacitor should be connected to
each V
DDA pin.
FIGURE 1. POWER SUPPLY FILTERING
10
V
DDA
10
F
.01
F
3.3V or 2.5V
.01
F
V
DD
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PDF描述 |
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