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参数资料
| 型号： | ICS844201BG-45LF |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 3/16页 |
| 文件大小： | 0K |
| 描述： | IC CLK GENERATOR 25MHZ 8TSSOP |
| 标准包装： | 96 |
| 系列： | HiPerClockS™, FemtoClock™, PCI Express® (PCIe) |
| 类型： | 时钟/频率发生器，合成器 |
| PLL： | 是 |
| 主要目的： | PCI Express（PCIe） |
| 输入： | 晶体 |
| 输出： | LVDS |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:1 |
| 差分 - 输入:输出： | 无/是 |
| 频率 - 最大： | 125MHz |
| 电源电压： | 2.97 V ~ 3.63 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 8-TSSOP（0.173"，4.40mm 宽） |
| 供应商设备封装： | 8-TSSOP |
| 包装： | 管件 |
ICS844201I-45 Data Sheet
FEMTOCLOCK CRYSTAL-TO-LVDS CLOCK GENERATOR
ICS844201BKI-45 REVISION A OCTOBER 7, 2013
11
2013 Integrated Device Technology, Inc.
Schematic Example
Figure 4 shows an example of ICS844201I-45 application schematic.
In this example, the device is operated at VDD = 3.3V. The 18pF
parallel resonant 25MHz crystal is used. The C1 = 27pF and C2 =
27pF are recommended for frequency accuracy. For different board
layouts, the C1 and C2 may be slightly adjusted for optimizing
frequency accuracy. Two examples of LVDS for receiver without
built-in termination are shown in this schematic.
Figure 4. ICS844201I-45 Schematic Example
R1
100
VDD=3.3V
R4
50
Set Logic
Input to
'1'
Q
VDD
Logic Input Pin Examples
Zo = 50 Ohm
C1
27pF
XTAL_OUT
Zo = 50 Ohm
C9
0.1uF
FSEL
RD1
Not Install
VDD
nQ
Zo = 50 Ohm
Q
+
-
XTAL_IN
To Logic
Input
pins
nQ
1 8 p F
VDD
R3
50
Set Logic
Input to
'0'
Zo = 50 Ohm
RU2
Not Install
U1
1
2
3
4
5 6 7 8
9
10
11
12
13
14
15
16
nc
XTAL_OUT
XTAL_IN
FSEL
GN
D
nc nc nc
nc
VDD
nQ
Q
nc
GN
D
+
-
X1
25 MHz
RU1
1K
Alternate
LVDS
Termination
To Logic
Input
pins
C2
27pF
C3
0.01u
RD2
1K
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PDF描述 |
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