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参数资料
| 型号： | ICS850S1201BGILFT |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 6/13页 |
| 文件大小： | 0K |
| 描述： | IC CLOCK MUX 12:1 250MHZ 20TSSOP |
| 标准包装： | 2,500 |
| 系列： | HiPerClockS™ |
| 类型： | 多路复用器 |
| 电路数： | 1 |
| 比率 - 输入:输出： | 12:1 |
| 差分 - 输入:输出： | 无/无 |
| 输入： | LVCMOS，LVTTL |
| 输出： | LVCMOS，LVTTL |
| 频率 - 最大： | 250MHz |
| 电源电压： | 2.375 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 20-TSSOP（0.173"，4.40mm 宽） |
| 供应商设备封装： | 20-TSSOP |
| 包装： | 带卷 (TR) |
ICS850S1201BGI REVISION A JANUARY 4, 2010
2
2010 Integrated Device Technology, Inc.
ICS850S1201I Data Sheet
12:1 SINGLE-ENDED MULTIPLEXER
Table 1. Pin Descriptions
NOTE: Pullup and Pulldown refer to internal input resistors. See Table 2, Pin Characteristics, for typical values.
Table 2. Pin Characteristics
Number
Name
Type
Description
1
CLK8
Input
Pulldown
Single-ended clock input. LVCMOS/LVTTL interface levels.
2
CLK9
Input
Pulldown
Single-ended clock input. LVCMOS/LVTTL interface levels.
3
CLK10
Input
Pulldown
Single-ended clock input. LVCMOS/LVTTL interface levels.
4
CLK11
Input
Pulldown
Single-ended clock input. LVCMOS/LVTTL interface levels.
5VDD
Power
Power supply pin.
6,
7.
8,
9
CLK_SEL0,
CLK_SEL1,
CLK_SEL2,
CLK_SEL3
Input
Pulldown
Clock select inputs. See Table 3. LVCMOS / LVTTL interface levels.
10
OE
Input
Pullup
Output enable pin for Q output. LVCMOS/LVTTL interface levels.
11
Q
Output
Single-ended clock output. LVCMOS/LVTTL interface levels.
12
GND
Power
Power supply ground.
13
CLK0
Input
Pulldown
Single-ended clock input. LVCMOS/LVTTL interface levels.
14
CLK1
Input
Pulldown
Single-ended clock input. LVCMOS/LVTTL interface levels.
15
CLK2
Input
Pulldown
Single-ended clock input. LVCMOS/LVTTL interface levels.
16
CLK3
Input
Pulldown
Single-ended clock input. LVCMOS/LVTTL interface levels.
17
CLK4
Input
Pulldown
Single-ended clock input. LVCMOS/LVTTL interface levels.
18
CLK5
Input
Pulldown
Single-ended clock input. LVCMOS/LVTTL interface levels.
19
CLK6
Input
Pulldown
Single-ended clock input. LVCMOS/LVTTL interface levels.
20
CLK7
Input
Pulldown
Single-ended clock input. LVCMOS/LVTTL interface levels.
Symbol
Parameter
Test Conditions
Minimum
Typical
Maximum
Units
CIN
Input Capacitance
2pF
CPD
Power Dissipation Capacitance
VDD = 3.465V
10
pF
VDD = 2.625V
8
pF
RPULLUP
Input Pullup Resistor
51
k
RPULLDOWN Input Pulldown Resistor
51
k
ROUT
Output Impedance
VDD = 3.3V±5%
20
VDD = 2.5V±5%
25
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