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参数资料
| 型号： | ICS8521BYLN |
| 元件分类： | 时钟及定时 |
| 英文描述： | 8521 SERIES, LOW SKEW CLOCK DRIVER, 9 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQFP32 |
| 封装： | 7 X 7 MM, 1.40 MM HEIGHT, LEAD FREE/ANNEALED MS-026, LQFP-32 |
| 文件页数： | 1/15页 |
| 文件大小： | 280K |
| 代理商： | ICS8521BYLN |
Integrated
Circuit
Systems, Inc.
ICS8521
LOW SKEW, 1-TO-9
DIFFERENTIAL-TO-HSTL FANOUT BUFFER
8521BY
www.icst.com/products/hiperclocks.html
REV. D JULY 7, 2004
1
GENERAL DESCRIPTION
The ICS8521 is a low skew, 1-to-9 Differential-
to-HSTL Fanout Buffer and a member of the
HiPerClockSfamily of High Performance Clock
Solutions from ICS. The ICS8521 has two select-
able clock inputs. The CLK, nCLK pair can ac-
cept most standard differential input levels. The PCLK, nPCLK
pair can accept LVPECL, CML, or SSTL input levels. The clock
enable is internally synchronized to eliminate runt pulses on
the outputs during asynchronous assertion/deassertion of the
clock enable pin.
Guaranteed output skew, part-to-part skew and crossover
voltage characteristics make the ICS8521 ideal for today’s
most advanced applications, such as IA64 and static RAMs.
HiPerClockS
ICS
FEATURES
9 HSTL outputs
Selectable differential CLK, nCLK or LVPECL clock inputs
CLK, nCLK pair can accept the following differential input
levels: LVPECL, LVDS, HSTL, SSTL, HCSL
PCLK, nPCLK supports the following input types:
LVPECL, CML, SSTL
Maximum output frequency: 500MHz
Output skew: 50ps (maximum)
Part-to-part skew: 250ps (maximum)
Propagation delay: 1.8ns (maximum)
V
OH = 1.4V (maximum)
3.3V core, 1.8V output operating supply voltages
0°C to 70°C ambient operating temperature
Industrial temperature information available upon request
BLOCK DIAGRAM
PIN ASSIGNMENT
32 3 1 30 29 28 27 26 25
9 10 11 12 13 14 15 16
1
2
3
4
5
6
7
8
24
23
22
21
20
19
18
17
VDDO
Q3
nQ3
Q4
nQ4
Q5
nQ5
VDDO
ICS8521
V
DDO
Q6
nQ6
Q7
nQ7
Q8
nQ8
V
DDO
V
DDO
nQ2
Q2
nQ1
Q1
nQ0
Q0
V
DDO
VDD
CLK
nCLK
CLK_SEL
PCLK
nPCLK
GND
CLK_EN
32-Lead LQFP
7mm x 7mm x 1.4mm Package Body
Y Package
Top View
CLK
nCLK
PCLK
nPCLK
Q0
nQ0
Q1
nQ1
Q2
nQ2
Q3
nQ3
Q4
nQ4
Q5
nQ5
Q6
nQ6
Q7
nQ7
Q8
nQ8
D
Q
LE
CLK_EN
CLK_SEL
0
1
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PDF描述 |
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