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参数资料
| 型号： | ICS853017AMLF |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | 时钟及定时 |
| 英文描述： | 853017 SERIES, LOW SKEW CLOCK DRIVER, 1 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO20 |
| 封装： | 7.50 X 12.80 MM, 2.30 MM HEIGHT, ROHS COMPLIANT, MS-013, MO-119, SOIC-20 |
| 文件页数： | 14/15页 |
| 文件大小： | 284K |
| 代理商： | ICS853017AMLF |
IDT / ICS 2.5V, 3.3V, 5V LVPECL/ECL RECEIVER
8
ICS853017AM REV. B JANUARY 28, 2008
ICS853017
QUAD, 1-TO-1, DIFFERENTIAL-TO-2.5V, 3.3V, 5V LVPECL/ECL RECEIVER
PRELIMINARY
LVPECL CLOCK INPUT INTERFACE
The Dx /nDx accepts LVPECL, CML, SSTL and other differential
signals. Both V
SWING
and V
OH
must meet the V
PP
and V
CMR
input
requirements.
Figures 2A to 2E show interface examples for
the HiPerClockS Dx/nDx input driven by the most common driver
types. The input interfaces suggested here are examples only.
If the driver is from another vendor, use their termination
recommendation. Please consult with the vendor of the driver
component to confirm the driver termination requirements.
FIGURE 2A. HIPERCLOCKS D/nD INPUT DRIVEN
BY A
CML DRIVER
FIGURE 2B. HIPERCLOCKS D/nD INPUT DRIVEN
BY AN
SSTL DRIVER
FIGURE 2C. HIPERCLOCKS D/nD INPUT DRIVEN
BY A
3.3V LVPECL DRIVER
FIGURE 2D. HIPERCLOCKS D/nD INPUT DRIVEN
BY A
3.3V LVDS DRIVER
FIGURE 2E. HIPERCLOCKS D/nD INPUT DRIVEN
BY A
3.3V LVPECL DRIVER WITH AC COUPLE
3.3V
R1
100
LVDS
Dx
nDx
3.3V
HiPerClock
Zo = 50
Ω
Zo = 50
Ω
100
Ω Differential Transmission Line
Dx
nDx
HiPerClockS
PCLK/nPCLK
CML
3.3V
Zo = 50
Ω
Zo = 50
Ω
3.3V
R1
50
R2
50
Dx
nDx
HiPerClockS
PCLK/nPCLK
SSTL
2.5V
Zo = 60
Ω
Zo = 60
Ω
2.5V
3.3V
R1
120
R2
120
R3
120
R4
120
R3
125
R4
125
R1
84
R2
84
3.3V
Zo = 50
Ω
Zo = 50
Ω
Dx
nDx
3.3V
LVPECL
HiPerClockS
Input
R3
84
R4
84
R1
125
R2
125
R5
100 - 200
R6
100 - 200
Dx
nDx
3.3V LVPECL
3.3V
Zo = 50
Ω
Zo = 50
Ω
3.3V
HiPerClockS
PCLK/nPCLK
C1
C2
相关PDF资料 |
PDF描述 |
|---|---|
| ICS853017AMT | LOW SKEW CLOCK DRIVER, 1 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO20 |
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