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参数资料
型号： ICS8534AY-01T
厂商： INTEGRATED DEVICE TECHNOLOGY INC
元件分类： 时钟及定时
英文描述： 8534 SERIES, LOW SKEW CLOCK DRIVER, 22 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQFP64
封装： 10 X 10 MM, 1 MM HEIGHT, MS-026ACD-HD, TQFP-64
文件页数： 2/20页
文件大小： 1733K
代理商： ICS8534AY-01T
ICS8534-01
LOW SKEW, 1-TO-22 DIFFERENTIAL-TO-3.3V LVPECL FANOUT BUFFER
IDT / ICS 3.3V LVPECL FANOUT BUFFER
10
ICS8534AY-01 REV. A DECEMBER 6, 2007
Differential Clock Input Interface
The CLK /nCLK accepts LVPECL, LVDS, LVHSTL and other
differential signals. Both VSWING and VOH must meet the VPP and
VCMR input requirements. Figures 3A to 3F show interface
examples for the HiPerClockS CLK/nCLK input driven by the most
common driver types. The input interfaces suggested here are
examples only. If the driver is from another vendor, use their
termination recommendation. Please consult with the vendor of the
driver component to confirm the driver termination requirements.
Figure 3A. HiPerClockS CLK/nCLK Input Driven by an
IDT Open Collector CML Driver
Figure 3C. HiPerClockS CLK/nCLK Input
Driven by a 3.3V LVPECL Driver
Figure 3E. HiPerClockS CLK/nCLK Input
Driven by an SSTL Driver
Figure 3B. HiPerClockS CLK/nCLK Input
Driven by a Built-In Pullup CML Driver
Figure 3D. HiPerClockS CLK/nCLK Input Driven by
a 3.3V LVPECL Driver with AC Couple
Figure 3F. HiPerClockS CLK/nCLK Input Driven by
a 3.3V LVDS Driver
CLK
nCLK
HiPerClockS
CML
3.3V
Zo = 50
Zo = 50
3.3V
R1
50
R2
50
R3
125
R4
125
R1
84
R2
84
3.3V
Zo = 50
Zo = 50
CLK
nCLK
3.3V
LVPECL
HiPerClockS
CLK
nCLK
HiPerClockS
SSTL
2.5V
Zo = 60
Zo = 60
2.5V
3.3V
R1
120
R2
120
R3
120
R4
120
3.3V
R1
100
CML Built-In Pullup
CLK
nCLK
3.3V
HiPerClockS
Zo = 50
Zo = 50
R1
125
R2
125
R5
100 - 200
R6
100 - 200
CLK
nCLK
3.3V LVPECL
3.3V
Zo = 50
Zo = 50
3.3V
HiPerClockS
C1
C2
3.3V
R1
100
LVDS
CLK
nCLK
3.3V
HiPerClockS
Zo = 50
Zo = 50
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PDF描述
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