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参数资料
| 型号： | ICS85352AYILFT |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 1/20页 |
| 文件大小： | 0K |
| 描述： | IC CLOCK MUX 2:12 700MHZ 48-TQFP |
| 标准包装： | 1,000 |
| 系列： | HiPerClockS™ |
| 类型： | 多路复用器 |
| 电路数： | 1 |
| 比率 - 输入:输出： | 2:12 |
| 差分 - 输入:输出： | 是/是 |
| 输入： | HCSL，LVDS，LVHSTL，LVPECL，SSTL |
| 输出： | LVPECL |
| 频率 - 最大： | 700MHz |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 48-TQFP 裸露焊盘 |
| 供应商设备封装： | 48-PTQFP-EP（7x7） |
| 包装： | 带卷 (TR) |
| 其它名称： | 85352AYILFT |
DATA SHEET
ICS85352AYI REVISION C AUGUST 3, 2010
1
2010 Integrated Device Technology, Inc.
12 Bit, 2-to-1, 3.3V, 2.5V LVPECL
Clock Buffer
ICS85352I
General Description
The ICS85352I is a 12 bit, 2-to-1 LVPECL Clock Buffer. Individual
input select controls support independent multiplexer operation from
a common clock input source. Clock inputs accept most standard
differential levels.
The ICS85352I is characterized at full 3.3V or mixed 3.3V core/2.5V
output operating supply modes.
Features
Twelve, 2-to-1 multiplexers with LVPECL outputs
Selectable differential CLKx, nCLKx input pairs
CLK, nCLK pair can accept the following differential input
levels: LVPECL, LVDS, LVHSTL, HCSL, SSTL
Maximum output frequency: 700MHz
Individual select control for each multiplexer
Select inputs accept LVCMOS / LVTTL levels
Propagation delay: 2ns (maximum)
Additive Phase Jitter, RMS: 0.21ps (typical), 3.3V
Full 3.3V or mixed 3.3V core/2.5V output supply
-40°C to 85°C ambient operating temperature
Available in both standard (RoHS 5) and lead-free (RoHS 6)
packages
48 47 46 45 44 43 42 41 40 39 38 37
13 14 15 16 17 18 19 20 21 22 23 24
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Q0
nQ0
Q1
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Q10
nQ10
Q11
nQ11
V
CCO
V
EE
V
CC
SEL11
SEL10
SEL9
SEL3
SEL4
SEL5
V
CC
V
EE
V
CCO
ICS85352I
V
CCO
CLK1
nCLK1
SEL8
SEL7
SEL6
SEL0
SEL1
SEL2
CLK0
nCLK0
V
CCO
0
1
0
1
12
nQ0
Q0
nQ11
Q11
SEL0:SEL11
CLK0
nCLK0
CLK1
nCLK1
Pulldown
Pullup/Pulldown
Pulldown
Block Diagram
Pin Assignment
ICS85352I
48-Lead TQFP, E-Pad
7mm x 7mm x 1.0mm package body
Y Package
Top View
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