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参数资料
| 型号： | ICS853S006AGILF |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 3/19页 |
| 文件大小： | 0K |
| 描述： | IC CLOCK BUFFER 1:6 2GHZ 20TSSOP |
| 特色产品： | IDT - ?LVPECL Buffer |
| 标准包装： | 74 |
| 系列： | HiPerClockS™ |
| 类型： | 扇出缓冲器（分配） |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:6 |
| 差分 - 输入:输出： | 是/是 |
| 输入： | CML，LVDS，LVPECL，SSTL |
| 输出： | ECL，PECL |
| 频率 - 最大： | 2GHz |
| 电源电压： | 2.375 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 20-TSSOP（0.173"，4.40mm 宽） |
| 供应商设备封装： | 20-TSSOP |
| 包装： | 管件 |
| 其它名称： | 800-2247 |
ICS853S006I Data Sheet
LOW SKEW, 1-TO-6, DIFFERENTIAL-TO-2.5V, 3.3V LVPECL/ECL FANOUT BUFFER
ICS853S006AGI REVISION A NOVEMBER 15, 2011
11
2011 Integrated Device Technology, Inc.
LVPECL Clock Input Interface
The PCLK /nPCLK accepts LVPECL, LVDS, CML and other
differential signals. Both VSWING and VOH must meet the VPP and
VCMR input requirements. Figures 3A to 3E show interface examples
for the PCLK/nPCLK input driven by the most common driver types.
The input interfaces suggested here are examples only. If the driver
is from another vendor, use their termination recommendation.
Please consult with the vendor of the driver component to confirm the
driver termination requirements.
Figure 3A. PCLK/nPCLK Input
Driven by a CML Driver
Figure 3C. PCLK/nPCLK Input
Driven by a 3.3V LVPECL Driver
Figure 3E. PCLK/nPCLK Input Driven by
a 3.3V LVDS Driver
Figure 3B. PCLK/nPCLK Input
Driven by a Built-In Pullup CML Driver
Figure 3D. PCLK/nPCLK Input Driven by
a 3.3V LVPECL Driver with AC Couple
PCLK
nPCLK
LVPECL
Input
CML
3.3V
Zo = 50
Ω
Zo = 50
Ω
3.3V
R1
50
Ω
R2
50
Ω
R3
125
Ω
R4
125
Ω
R1
84
Ω
R2
84
Ω
3.3V
Zo = 50
Ω
Zo = 50
Ω
PCLK
nPCLK
3.3V
LVPECL
Input
PCLK
nPCLK
VBB
3.3V
LVPECL
Input
R1
1k
R2
1k
3.3V
Zo = 50
Ω
Zo = 50
Ω
C1
C2
R5
100
Ω
LVDS
C3
0.1F
3.3V
R1
100
Ω
CML Built-In Pullup
PCLK
nPCLK
3.3V
LVPECL
Input
Zo = 50
Ω
Zo = 50
Ω
R1
50
Ω
R2
50
Ω
R5
100
Ω - 200Ω
R6
100
Ω - 200Ω
PCLK
VBB
nPCLK
3.3V LVPECL
3.3V
Zo = 50
Ω
Zo = 50
Ω
3.3V
LVPECL
Input
C1
C2
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