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参数资料
| 型号： | ICS85411AMT |
| 元件分类： | 时钟及定时 |
| 英文描述： | LOW SKEW CLOCK DRIVER, 2 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO8 |
| 封装： | 3.90 X 4.90 MM, 1.37 MM HEIGHT, MS-012, SOIC-8 |
| 文件页数： | 1/13页 |
| 文件大小： | 189K |
| 代理商： | ICS85411AMT |
85411AM
www.icst.com/products/hiperclocks.html
REV. B JUNE 16, 2004
1
Integrated
Circuit
Systems, Inc.
ICS85411
LOW SKEW, 1-TO-2
DIFFERENTIAL-TO-LVDS FANOUT BUFFER
GENERAL DESCRIPTION
The ICS85411 is a low skew, high performance
1-to-2 Differential-to-LVDS Fanout Buffer and a
member of the HiPerClockSfamily of High
Perfor mance Clock Solutions from ICS. The
CLK, nCLK pair can accept most standard differ-
ential input levels.The ICS85411 is characterized to oper-
ate from a 3.3V power supply. Guaranteed output and
par t-to-par t skew character istics make the ICS85411
ideal for those clock distribution applications demand-
ing well defined perfor mance and repeatability.
FEATURES
2 differential LVDS outputs
1 differential CLK, nCLK clock input
CLK, nCLK pair can accept the following differential
input levels: LVPECL, LVDS, LVHSTL, SSTL, HCSL
Maximum output frequency: 650MHz
Translates any single ended input signal to
LVDS levels with resistor bias on nCLK input
Output skew: 20ps (maximum)
Part-to-part skew: 250ps (maximum)
Additive phase jitter, RMS: 0.05ps (typical)
Propagation delay: 2.5 ns (maximum)
3.3V operating supply
0°C to 70°C ambient operating temperature
Lead-Free package available
Industrial temperature information available upon request
BLOCK DIAGRAM
PIN ASSIGNMENT
ICS85411
8-Lead SOIC
3.90mm x 4.90mm x 1.37mm package body
M Package
Top View
Q0
nQ0
Q1
nQ1
1
2
3
4
HiPerClockS
ICS
VDD
CLK
nCLK
GND
8
7
6
5
Q0
nQ0
Q1
nQ1
CLK
nCLK
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PDF描述 |
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