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参数资料
| 型号： | ICS854S01AKILF |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 11/18页 |
| 文件大小： | 0K |
| 描述： | IC CLOCK MUX 2:1 2.5GHZ 16-QFN |
| 特色产品： | LVDS Buffers and Muxes |
| 标准包装： | 100 |
| 系列： | HiPerClockS™ |
| 类型： | 多路复用器 |
| 电路数： | 1 |
| 比率 - 输入:输出： | 2:1 |
| 差分 - 输入:输出： | 是/是 |
| 输入： | LVDS，LVPECL |
| 输出： | LVDS |
| 频率 - 最大： | 2.5GHz |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 16-VFQFN 裸露焊盘 |
| 供应商设备封装： | 16-VFQFN（3x3） |
| 包装： | 管件 |
| 其它名称： | 800-2561 |
ICS854S01AKI REVISION A OCTOBER 29, 2012
2
2012 Integrated Device Technology, Inc.
ICS854S01I Data Sheet
2:1 DIFFERENTIAL-TO-LVDS MULTIPLEXER
Table 1. Pin Descriptions
NOTE: Pullup and Pulldown refer to internal input resistors. See Table 2, Pin Characteristics, for typical values.
Table 2. Pin Characteristics
Function Tables
Table 3. Control Input Function Table
Number
Name
Type
Description
1
PCLK0
Input
Pulldown
Non-inverting differential clock input.
2
nPCLK0
Input
Pullup/
Pulldown
Inverting differential clock input. VDD/2 default when left floating.
3
PCLK1
Input
Pulldown
Non-inverting differential clock input.
4
nPCLK1
Input
Pullup/
Pulldown
Inverting differential clock input. VDD/2 default when left floating.
5
RESERVED
Reserve
Reserve pin.
6
CLK_SEL
Input
Pulldown
Clock select input. When HIGH, selects PCLK1, nPCLK1 inputs. When
LOW, selects PCLK0, nPCLK0 inputs. LVCMOS / LVTTL interface levels.
7, 16
nc
Unused
No connects.
8, 13
VDD
Power
Power supply pins.
9, 12, 14, 15
GND
Power
Power supply ground.
10, 11
nQ, Q
Output
Differential output pair. LVDS interface levels.
Symbol
Parameter
Test Conditions
Minimum
Typical
Maximum
Units
CIN
Input Capacitance
2
pF
RPULLUP
Input Pullup Resistor
37
k
RPULLDOWN
Input Pulldown Resistor
37
k
CLK_SEL
PCLK Selected
0
PCLK0, nPCLK0
1
PCLK1, nPCLK1
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PDF描述 |
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