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参数资料
| 型号： | ICS854S54AYI-08LF |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | 时钟及定时 |
| 英文描述： | 854S SERIES, LOW SKEW CLOCK DRIVER, 12 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQFP64 |
| 封装： | 10 X 10 MM, 1 MM HEIGHT, ROHS COMPLIANT, MS-026, TQFP-64 |
| 文件页数： | 13/19页 |
| 文件大小： | 306K |
| 代理商： | ICS854S54AYI-08LF |
IDT / ICS LVDS MULTIPLEXER
3
ICS854S54AYI-08 REV B JANUARY 16, 2008
ICS854S54I-08
OCTAL 2:1 AND 1:2 DIFFERENTIAL-TO-LVDS MULTIPLEXER
PRELIMINARY
The ICS854S54I-08 uses an industry standard I2C interface
to control the direction of the 4 separate 2:1/1:2 mux switch
blocks. Each individual block is controlled by two bits of the 8
I2C ADDRESSING
The ICS854S54I-08 can be set to decode one of four addresses
to minimize the chance of address conflict on the I2C bus. The
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Data Byte 0
address that is decoded is controlled by the setting of the ADR_1,
ADR_0 (pins 24 and 25).
bit Data Byte. The Data Byte bit pairs are summarized as fol-
lows:
Bit Pair 1 – INA0/nINA0, INA1/nINA1, INB/nINB, QB/nQB
SEL_QB:MODE_QAx
Bit Pair 2 - INC0/nINC0, INC1/nINC1, IND/nIND, QD/nQD
SEL_QD:MODE_QCx
Bit Pair 3 – INE0/nINE0, INE1/nINE1, INF/nINF, QF/nQF
SEL_QF:MODE_QEx
Bit Pair 4 – ING0/nING0, ING1/nING1, INH/nINH, QH/nQH
SEL_QH:MODE_QGx
CONTROL SIGNALS
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PDF描述 |
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