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参数资料
| 型号： | ICS8624BYI |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | 时钟及定时 |
| 英文描述： | PLL BASED CLOCK DRIVER, 5 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQFP32 |
| 封装： | 7 X 7 MM, 1.40 MM HEIGHT, LQFP-32 |
| 文件页数： | 3/15页 |
| 文件大小： | 511K |
| 代理商： | ICS8624BYI |
8624BYI
www.icst.com/products/hiperclocks.html
REV. B NOVEMBER 15, 2005
11
Integrated
Circuit
Systems, Inc.
ICS8624I
LOW SKEW, 1-TO-5
DIFFERENTIAL-TO-HSTL ZERO DELAY BUFFER
3. Calculations and Equations.
The purpose of this section is to derive the power dissipated into the load.
HSTL output driver circuit and termination are shown in Figure 4.
To calculate worst case power dissipation into the load, use the following equations which assume a 50
Ω load.
Pd_H is power dissipation when the output drives high.
Pd_L is the power dissipation when the output drives low.
Pd_H = (V
OH_MIN
/R
L
) * (V
DDO_M
AX
- V
OH_M
IN
)
Pd_L = (V
OL_MAX
/R
L
) * (V
DDO_MAX
- V
OL_MAX
)
Pd_H = (1V/50
Ω) * (2V - 1V) = 20mW
Pd_L = (0.4V/50
Ω) * (2V - 0.4V) = 12.8mW
Total Power Dissipation per output pair = Pd_H + Pd_L = 32.8mW
FIGURE 4. HSTL DRIVER CIRCUIT AND TERMINATION
V
DDO
V
OUT
RL
50
Ω
Q1
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PDF描述 |
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