参数资料
型号: ICS8633AF-01LF
厂商: IDT, Integrated Device Technology Inc
文件页数: 15/16页
文件大小: 0K
描述: IC BUFFER ZD 2-3 LVPECL 28-SSOP
标准包装: 47
系列: HiPerClockS™
类型: 扇出配送,多路复用器,零延迟缓冲器
PLL: 带旁路
输入: HCSL,LVDS,LVHSTL,LVPECL,SSTL
输出: LVPECL
电路数: 1
比率 - 输入:输出: 2:3
差分 - 输入:输出: 是/是
频率 - 最大: 700MHz
除法器/乘法器: 是/无
电源电压: 3.135 V ~ 3.465 V
工作温度: 0°C ~ 70°C
安装类型: 表面贴装
封装/外壳: 28-SSOP(0.209",5.30mm 宽)
供应商设备封装: 28-SSOP
包装: 管件
其它名称: 800-2396-5
8633AF-01LF
ICS8633AF-01LF-ND
8633AF-01
www.idt.com
REV. B AUGUST 2, 2010
8
ICS8633-01
1-TO-3 DIFFERENTIAL-TO-3.3V LVPECL
ZERO DELAY BUFFER
V
CC - 2V
50
Ω
50
Ω
RTT
Z
o = 50Ω
Z
o = 50Ω
FOUT
FIN
RTT =
Z
o
1
((V
OH + VOL) / (VCC – 2)) – 2
3.3V
125
Ω
125
Ω
84
Ω
84
Ω
Z
o = 50Ω
Z
o = 50Ω
FOUT
FIN
The clock layout topology shown below is a typical termina-
tion for LVPECL outputs. The two different layouts mentioned
are recommended only as guidelines.
FOUT and nFOUT are low impedance follower outputs that gen-
erate ECL/LVPECL compatible outputs. Therefore, terminating
resistors (DC current path to ground) or current sources must
be used for functionality. These outputs are designed to drive
50
Ω transmission lines. Matched impedance techniques should
be used to maximize operating frequency and minimize signal
distortion.
Figures 4A and 4B show two different layouts which
are recommended only as guidelines. Other suitable clock lay-
outs may exist and it would be recommended that the board
designers simulate to guarantee compatibility across all printed
circuit and clock component process variations.
TERMINATION FOR LVPECL OUTPUTS
FIGURE 4B. LVPECL OUTPUT TERMINATION
FIGURE 4A. LVPECL OUTPUT TERMINATION
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