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参数资料
| 型号： | ICS86953BYILF-147 |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | 时钟及定时 |
| 英文描述： | PLL BASED CLOCK DRIVER, 8 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQFP32 |
| 封装： | 7 X 7 MM, 1.40 MM HEIGHT, MS-026, LQFP-32 |
| 文件页数： | 1/13页 |
| 文件大小： | 262K |
| 代理商： | ICS86953BYILF-147 |
86953BYI-147
www.icst.com/products/hiperclocks.html
REV. B APRIL 23, 2004
1
Integrated
Circuit
Systems, Inc.
ICS86953I-147
LOW SKEW, 1-TO-9
DIFFERENTIAL-TO-LVCMOS / LVTTL ZERO DELAY BUFFER
GENERAL DESCRIPTION
The ICS86953I-147 is a low voltage, low skew
1-to-9 Differential-to-LVCMOS/LVTTL Clock
Generator and a member of the HiPerClockS
family of High Performance Clock Solutions from
ICS.The PCLK, nPCLK pair can accept most stan-
dard differential input levels.With output frequencies up to 175MHz,
the ICS86953I-147 is targeted for high performance clock ap-
plications. Along with a fully integrated PLL, the ICS86953I-147
contains frequency configurable outputs and an external feed-
back input for regenerating clocks with “zero delay”.
FEATURES
9 single ended LVCMOS/LVTTL outputs;
(8) clocks, (1) feedback
PCLK, nPCLK pair can accept the following differential
input levels: LVPECL, CML, SSTL
Maximum output frequency: PLL Mode, 175MHz
VCO range: 250MHz to 700MHz
Output skew: 75ps (maximum)
Cycle-to-cycle jitter: 50ps (maximum)
Static phase offset: 90ps ± 110ps
3.3V supply voltage
-40°C to 85°C ambient operating temperature
Pin compatible to the MPC953
BLOCK DIAGRAM
HiPerClockS
ICS
32-Lead LQFP
7mm x 7mm x 1.4mm package body
Y package
Top View
Q1
VDDO
Q2
GND
Q3
VDDO
Q4
GND
32 31 30 29 28 27 26 25
9
10 11 12 13 14 15 16
1
2
3
4
5
6
7
8
24
23
22
21
20
19
18
17
ICS86953I-147
Q5
V
DDO
Q6
GND
Q7
V
DDO
MR/nOE
nPCLK
VDDA
FB_CLK
nc
GND
PCLK
GND
Q0
V
DDO
QFB
GND
PLL_SEL
nBYP
A
S
VCO_SEL
PIN ASSIGNMENT
Phase
Detector
LPF
VCO
÷2
÷4
0
1
0
1
PCLK
nPCLK
FB_CLK
VCO_SEL
nBYPASS
MR/nOE
PLL_SEL
QFB
Q0:Q6
Q7
7/
0
1
相关PDF资料 |
PDF描述 |
|---|---|
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