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参数资料
| 型号： | ICS86962CYI-01LFT |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | 时钟及定时 |
| 英文描述： | 86962 SERIES, PLL BASED CLOCK DRIVER, 17 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQFP32 |
| 封装： | 7 X 7 MM, 1.40 MM HEIGHT, MS-026, LQFP-32 |
| 文件页数： | 1/12页 |
| 文件大小： | 167K |
| 代理商： | ICS86962CYI-01LFT |
86962CYI-01
www.icst.com/products/hiperclocks.html
REV. A DECEMBER 14, 2004
1
Integrated
Circuit
Systems, Inc.
ICS86962I-01
LOW SKEW, 1-TO-18
LVCMOS/LVTTL ZERO DELAY BUFFER
BLOCK DIAGRAM
PIN ASSIGNMENT
GENERAL DESCRIPTION
The ICS86962I-01 is a low voltage, low skew
LVCMOS/LVTTL Zero Delay Buffer and a mem-
ber of the HiPerClockS family of High Perfor-
mance Clock Solutions from ICS. With output
frequencies up to 140MHz, the ICS86962I-01 is
targeted for high performance clock applications. Along with a
fully integrated PLL, the ICS86962I-01 contains frequency
configurable outputs and an external feedback input for regen-
erating clocks with “zero delay”.
HiPerClockS
ICS
FEATURES
Fully integrated PLL
18 LVCMOS/LVTTL outputs: 17 LVCMOS/LVTTL clock outputs,
1 QFB feedback output. 14
typical output impedance
1 differential LVPECL clock pair
PCLK, nPCLK pair supports the following input types:
LVPECL, LVDS, CML, SSTL
Input/Output frequency range: 60MHz to 140MHz
External feedback for “zero delay” clock regeneration
Output skew: 210ps (maximum)
Cycle-to-cycle jitter: 100ps (maximum)
Period jitter, RMS: 4ps (maximum)
Full 3.3V or 2.5V supply voltage
-40°C to 85°C ambient operating temperature
Pin compatible to MPC961
0
1
PLL
60MHz - 110MHz
110MHz - 140MHz
FB
REF
PCLK
nPCLK
FB_IN
F_RANGE
nOE
Q0
Q1
Q2
Q3
Q4
Q5
Q6
Q7
Q8
Q9
Q10
Q11
Q12
Q13
Q14
Q15
Q16
QFB
24 23 22 21 20 19 18 17
1
2
3
4
5
6
7
8
25
26
27
28
29
30
31
32
16
15
14
13
12
11
10
9
VDD
Q12
Q13
Q14
GND
Q15
Q16
QFB
Q5
Q4
Q3
GND
Q2
Q1
Q0
VDD
GND
PCLK
nPCLK
F_RANGE
V
DDA
nOE
FB_IN
V
DD
Q11
Q10
Q9
GND
Q8
Q7
Q6
V
DD
32-Lead LQFP
7mm x 7mm x 1.4mm package body
Y package
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ICS86962I-01
相关PDF资料 |
PDF描述 |
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