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参数资料
| 型号： | ICS87332AMI-01LF |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 13/14页 |
| 文件大小： | 0K |
| 描述： | IC CLK GEN /2 ECL/LVPECL 8-SOIC |
| 标准包装： | 97 |
| 系列： | HiPerClockS™ |
| 类型： | 时钟发生器 |
| PLL： | 无 |
| 输入： | HCSL，LVDS，LVHSTL，LVPECL，SSTL |
| 输出： | ECL，LVPECL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:1 |
| 差分 - 输入:输出： | 是/是 |
| 频率 - 最大： | 500MHz |
| 除法器/乘法器： | 是/无 |
| 电源电压： | 2.375 V ~ 3.8 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 8-SOIC（0.154"，3.90mm 宽） |
| 供应商设备封装： | 8-SOIC |
| 包装： | 管件 |
| 产品目录页面： | 1250 (CN2011-ZH PDF) |
| 其它名称： | 800-1204 800-1204-5 800-1204-ND 87332AMI-01LF |
ICS87332AMI-01 REVISION C NOVEMBER 16, 2009
8
2009 Integrated Device Technology, Inc.
ICS87332I-01 Data Sheet
÷
2DIFFERENTIAL-TO-2.5V/3.3V ECL/LVPECL CLOCK GENERATOR
FIGURE 5C. CLK/nCLK INPUT DRIVEN BY A 3.3V LVPECL
DRIVER
FIGURE 5B. CLK/nCLK INPUT DRIVEN BY A 3.3V LVPECL
DRIVER
FIGURE 5D. CLK/nCLK INPUT DRIVEN BY A 3.3V LVDS DRIVER
3.3V
R1
50
R3
50
Zo = 50 Ohm
LVPECL
Zo = 50 Ohm
HiPerClockS
CLK
nCLK
3.3V
Input
R2
50
Zo = 50 Ohm
Input
HiPerClockS
CLK
nCLK
3.3V
R3
125
R2
84
Zo = 50 Ohm
3.3V
R4
125
LVPECL
R1
84
3.3V
DIFFERENTIAL CLOCK INPUT INTERFACE
The CLK /nCLK accepts LVDS, LVPECL, LVHSTL, SSTL, HCSL
and other differential signals. Both V
SWING and VOH must meet the VPP
and V
CMR input requirements. Figures 5A to 5F show interface ex-
amples for the CLK/nCLK input driven by the most common driver
types. The input interfaces suggested here are examples only.
FIGURE 5A. CLK/nCLK INPUT DRIVEN BY AN IDT OPEN
EMITTER LVHSTL DRIVER
Please consult with the vendor of the driver component to confirm
the driver termination requirements. For example in Figure 5A,
the input termination applies for IDT open emitter LVHSTL drivers.
If you are using an LVHSTL driver from another vendor, use their
termination recommendation.
1.8V
R2
50
Input
LVHSTL Driver
ICS
HiPerClockS
R1
50
LVHSTL
3.3V
Zo = 50 Ohm
HiPerClockS
CLK
nCLK
FIGURE 5E. CLK/nCLK INPUT DRIVEN BY A 3.3V HCSL DRIVER
Zo = 50 Ohm
R1
100
3.3V
LVDS_Driv er
Zo = 50 Ohm
Receiv er
CLK
nCLK
3.3V
HCSL
*R3
33
*R4
33
CLK
nCLK
2.5V
3.3V
Zo = 50
Ω
Zo = 50
Ω
HiPerClockS
Input
R1
50
R2
50
*Optional – R3 and R4 can be 0
Ω
FIGURE 5F. CLK/nCLK INPUT DRIVEN BY A 2.5V SSTL DRIVER
CLK
nCLK
HiPerClockS
SSTL
2.5V
Zo = 60
Ω
Zo = 60
Ω
2.5V
3.3V
R1
120
R2
120
R3
120
R4
120
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