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参数资料
| 型号： | ICS874S02BMILFT |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 14/16页 |
| 文件大小： | 0K |
| 描述： | IC CLK GEN 1:1 DIFF ZD 20SOIC |
| 标准包装： | 1,000 |
| 系列： | HiPerClockS™ |
| 类型： | * |
| PLL： | 带旁路 |
| 输入： | HCSL，LVDS，LVHSTL，LVPECL，SSTL |
| 输出： | LVDS |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:1 |
| 差分 - 输入:输出： | 是/是 |
| 频率 - 最大： | 1GHz |
| 除法器/乘法器： | 是/是 |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 20-SOIC（0.295"，7.50mm 宽） |
| 供应商设备封装： | 20-SOIC |
| 包装： | 带卷 (TR) |
ICS874S02I
1:1 DIFFERENTIAL-TO-LVDS ZERO DELAY CLOCK GENERATOR
IDT / ICS LVDS CLOCK GENERATOR
7
ICS874S02BMI REV. AOCTOBER 16, 2008
Parameter Measurement Information
3.3V LVDS Output Load AC Test Circuit
Static Phase Offset
Output Rise/Fall Time
Differential Input Level
Cycle-to-Cycle Jitter
Output Duty Cycle/Pulse Width/Period
SCOPE
Qx
nQx
3.3V±5%
POWER SUPPLY
+–
Float GND
LVDS
VDDA
VDD,
VDDO
nCLK
CLK
nFB_IN
FB_IN
t()
V
OH
V
OL
V
OH
V
OL
tjit() =
t() – t() mean= Phase Jitter
t() mean = Static Phase Offset
Where t() is any random sample, and t() mean is the average
of the sampled cycles measured on the controlled edges)
20%
80%
20%
tR
t F
VOD
Q, QFB
nQ, nQFB
VDD
nCLK
CLK
GND
V
CMR
Cross Points
V
PP
tcycle n
tcycle n+1
tjit(cc) =
|tcycle n – tcycle n+1|
1000 Cycles
nQ, nQFB
Q, QFB
t
PW
t
PERIOD
t
PW
t
PERIOD
odc =
x 100%
Q, QFB
nQ, nQFB
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PDF描述 |
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