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参数资料
| 型号： | ICS87604AGILF |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 12/13页 |
| 文件大小： | 0K |
| 描述： | IC CLK MULT/ZD BUFFER 28-TSSOP |
| 标准包装： | 48 |
| 系列： | HiPerClockS™ |
| 类型： | 时钟/频率发生器，零延迟缓冲器，多路复用器 |
| PLL： | 是 |
| 主要目的： | PCI Express（PCIe） |
| 输入： | LVCMOS，LVTTL，晶体 |
| 输出： | LVCMOS，LVTTL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 2:5 |
| 差分 - 输入:输出： | 无/无 |
| 频率 - 最大： | 167.67MHz |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 28-TSSOP（0.240"，6.10mm 宽） |
| 供应商设备封装： | 28-TSSOP |
| 包装： | 管件 |
| 其它名称： | 800-1220 800-1220-5 800-1220-ND 87604AGILF |
ICS87601AGI REVISION B APRIL 1, 2010
8
2010 Integrated Device Technology, Inc.
ICS87604I
LOW VOLTAGE/LOW SKEW, 1:4 PCI/PCI-X ZERO DELAY CLOCK GENERATOR
OVERDRIVING THE CRYSTAL INTERFACE
The XTAL_IN input can be overdriven by an LVCMOS driver or by
one side of a differential driver through an AC coupling capacitor.
The XTAL_OUT pin can be left floating. The amplitude of the input
signal should be between 500mV and 1.8V and the slew rate
should not be less than .2V/nS. For 3.3V LVCMOS inputs, the
amplitude must be reduced from full swing to at least half the
swing in order to prevent signal interference with the power rail
and to reduce internal noise.
Figure 3A shows an example of the
interface diagram for a high speed 3.3V LVCMOS driver. This
configuration requires that the sum of the output impedance of
the driver (Ro) and the series resistance (Rs) equals the
transmission line impedance. In addition, matched termination at
the crystal input will attenuate the signal in half. This can be done
FIGURE 3A. GENERAL DIAGRAM FOR LVCMOS DRIVER TO XTAL INPUT INTERFACE
in one of two ways. First, R1 and R2 in parallel should equal the
transmission line impedance. For most 50 applications, R1 and
R2 can be 100
Ω. This can also be accomplished by removing R1
and changing R2 to 50
Ω. The values of the resistors can be
increased to reduce the loading for slower and weaker LVCMOS
driver. Figure 2 shows an example of the interface diagram for an
LVPECL driver. This is a standard LVPECL termination with one
side of the driver feeding the XTAL_IN input. It is recommended
that all components in the schematics be placed in the layout.
Though some components might not be used, they can be utilized
for debugging purposes. The datasheet specifications are
characterized and guaranteed by using a quartz crystal as the
input.
R2
100
R1
100
RS
43
Ro ~ 7 Ohm
Driv er_LVCMOS
Zo = 50 Ohm
C1
0.1uF
3.3V
Cry stal Input Interf ace
XTAL_IN
XTAL_OUT
Cry stal Input Interf ace
XTAL_IN
XTAL_OUT
R3
50
C1
0.1uF
R2
50
R1
50
Zo = 50 Ohm
LVPECL
Zo = 50 Ohm
VCC=3.3V
FIGURE 3B. GENERAL DIAGRAM FOR LVPECL DRIVER TO XTAL INPUT INTERFACE
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PDF描述 |
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