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参数资料
| 型号： | ICS87952AYI-147LF |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 1/13页 |
| 文件大小： | 0K |
| 描述： | IC CLK MULT/ZD BUFFER 32-LQFP |
| 标准包装： | 250 |
| 系列： | HiPerClockS™ |
| 类型： | 倍增器，零延迟缓冲器 |
| PLL： | 带旁路 |
| 输入： | LVCMOS，LVTTL |
| 输出： | LVCMOS，LVTTL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:11 |
| 差分 - 输入:输出： | 无/无 |
| 频率 - 最大： | 180MHz |
| 除法器/乘法器： | 是/无 |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 32-LQFP |
| 供应商设备封装： | 32-TQFP（7x7） |
| 包装： | 托盘 |
| 其它名称： | 87952AYI-147LF |
Low Skew, 1-to-11 LVCMOS/LVTTL
Clock Multiplier/Zero Delay Buffer
ICS87952I-147
DATA SHEET
ICS87952AYI-147 REVISION C AUGUST 4, 2009
1
2009 Integrated Device Technology, Inc.
BLOCK DIAGRAM
PIN ASSIGNMENT
24 23 22 21 20 19 18 17
1
2
3
4
5
6
7
8
25
26
27
28
29
30
31
32
16
15
14
13
12
11
10
9
VDDO
QA2
QA1
GNDO
QA0
VDD
VDDA
nPLL_EN
VDDO
QB2
QB3
GNDO
QC0
QC1
VDDO
VCO_SEL
F_SELC
F_SELB
F_SELA
MR/nOE
REF_CLK
GNDI
FB_IN
ICS87952I-147
32-Lead LQFP
7mm x 7mm x 1.4mm package body
Y package
Top View
PHASE
DETECTOR
nPLL_EN
REF_CLK
FB_IN
VCO_SEL
F_SELA
F_SELB
F_SELC
MR/nOE
QA0
QA1
QA2
QA3
QA4
QB0
QB1
QB2
QB3
GENERAL DESCRIPTION
The ICS87952I-147 is a low voltage, low skew
LVCMOS/LVTTL Clock Generator and a member of
the HiPerClockS family of High Performance Clock
Solutions from IDT. With output frequencies up to
180MHz, the ICS87952I-147 is targeted for high
performance clock applications. Along with a fully integrated PLL,
the ICS87952I-147 contains frequency configurable outputs and
an external feedback input for regenerating clocks with “zero de-
lay”.
For test and system debug purposes, the nPLL_EN input allows
the PLL to be bypassed. When HIGH, the MR/nOE input resets
the internal dividers and forces the outputs to the high impedance
state.
The low impedance LVCMOS/LVTTL outputs of the ICS87952I-
147 are designed to drive terminated transmission lines. The ef-
fective fanout of each output can be doubled by utilizing the abil-
ity of each output to drive two series terminated transmission lines.
FEATURES
Fully integrated PLL
Eleven LVCMOS / LVTTL outputs, 7Ω typical output impedance
LVCMOS / LVTTL REF_CLK input
Output frequency range up to 180MHz at V
DD = 3.3V ± 5%
VCO range: 240MHz - 480MHz
External feedback for “zero delay” clock regeneration
Cycle-to-cycle jitter: 100ps (maximum)
3.3V supply voltage
-40°C to 85°C ambient operating temperature
Available in both standard (RoHS 5) and lead-free (RoHS 6)
packages
HiPerClockS
ICS
QC0
QC1
÷4/÷6
÷4/÷2
÷2/÷4
÷2
VCO
240 - 480MHz
LFP
GNDO
QB1
QB0
V
DDO
V
DDO
QA4
QA3
GNDO
0
1
0
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PDF描述 |
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