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参数资料
| 型号： | ICS87952AYI-147LF |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 11/13页 |
| 文件大小： | 0K |
| 描述： | IC CLK MULT/ZD BUFFER 32-LQFP |
| 标准包装： | 250 |
| 系列： | HiPerClockS™ |
| 类型： | 倍增器，零延迟缓冲器 |
| PLL： | 带旁路 |
| 输入： | LVCMOS，LVTTL |
| 输出： | LVCMOS，LVTTL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:11 |
| 差分 - 输入:输出： | 无/无 |
| 频率 - 最大： | 180MHz |
| 除法器/乘法器： | 是/无 |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 32-LQFP |
| 供应商设备封装： | 32-TQFP（7x7） |
| 包装： | 托盘 |
| 其它名称： | 87952AYI-147LF |
ICS87952AYI-147 REVISION C AUGUST 4, 2009
7
2009 Integrated DeviceTechnology, Inc.
ICS87952I-147 Data Sheet
LOW SKEW, 1-TO-11 LVCMOS/LVTTL CLOCK MULTIPLIER/ZERO DELAY BUFFER
LAYOUT GUIDELINE
The schematic of the ICS87952I-147 layout example is shown in
Figure 2A. This layout example is used as a general guideline.
The layout in the actual system will depend on the selected com-
ponent types, the density of the components, the density of the
traces, and the stack up of the P.C. board.
FIGURE 2A. ICS87952I-147 LVCMOS/LVTTL CLOCK MULTIPLIER/ZERO DELAY BUFFER SCHEMATIC EXAMPLE
VDD
R3
43
(U1-20)
VD
D
C11
0.01u
F_SELA
RU1
1K
Logic Input Pin Examples
C4
0.1uF
C5
0.1uF
(U1-25)
VDD
R7
10 - 15
Ro ~ 7 Ohm
Q1
Driv er_LVCMOS
R2
43
Zo = 50
F_SELC
R4
1K
RD1
Not Install
VDD
U1
ICS87952
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
32
31
30
29
28
27
26
25
VCO_SEL
F_SELC
F_SELB
F_SELA
MR/nOE
REF_CLK
GNDI
FB_IN
nP
LL
_E
N
VD
D
A
VD
D
QA
0
GN
D
O
QA
1
QA
2
VD
D
O
GNDO
QA3
QA4
VDDO
QB0
QB1
GNDO
VD
D
O
QC
1
QC
O
GN
D
O
GN
D
O
QB
3
QB
2
VD
D
O
R5
1K
To Logic
Input
pins
RD2
1K
VDDO
Set Logic
Input to
'1'
(U1-32)
C16
10u
RU2
Not Install
R1
43
Receiv er
C2
0.1uF
C6
0.1uF
VDD
F_SELB
VDD
Zo = 50
Set Logic
Input to
'0'
To Logic
Input
pins
C3
0.1uF
(U1-21)
VDD=3.3V
(U1-16)
Zo = 50
C1
0.1u
Receiv er
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