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参数资料
| 型号： | ICS87952AYI-147LF |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 10/13页 |
| 文件大小： | 0K |
| 描述： | IC CLK MULT/ZD BUFFER 32-LQFP |
| 标准包装： | 250 |
| 系列： | HiPerClockS™ |
| 类型： | 倍增器，零延迟缓冲器 |
| PLL： | 带旁路 |
| 输入： | LVCMOS，LVTTL |
| 输出： | LVCMOS，LVTTL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:11 |
| 差分 - 输入:输出： | 无/无 |
| 频率 - 最大： | 180MHz |
| 除法器/乘法器： | 是/无 |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 32-LQFP |
| 供应商设备封装： | 32-TQFP（7x7） |
| 包装： | 托盘 |
| 其它名称： | 87952AYI-147LF |
ICS87952AYI-147 REVISION C AUGUST 4, 2009
6
2009 Integrated Device Technology, Inc.
ICS87952I-147 Data Sheet
LOW SKEW, 1-TO-11 LVCMOS/LVTTL CLOCK MULTIPLIER/ZERO DELAY BUFFER
APPLICATION INFORMATION
POWER SUPPLY FILTERING TECHNIQUES
As in any high speed analog circuitry, the power supply pins are
vulnerable to random noise. To achieve optimum jitter performance,
power supply isolation is required. The ICS87952I-147 provides
separate power supplies to isolate any high switching noise from
the outputs to the internal PLL. V
DD, VDDA, and VDDO should be indi-
vidually connected to the power supply plane through vias, and
0.01F bypass capacitors should be used for each pin.
Figure 1
illustrates this for a generic V
DD pin and also shows that VDDA re-
quires that an additional10
Ω resistor along with a 10F bypass
capacitor be connected to the V
DDA pin.
FIGURE 1. POWER SUPPLY FILTERING
VDD
VDDA
3.3V
10
Ω
10F
.01F
INPUTS:
LVCMOS CONTROL PINS
All control pins have internal pulldowns; additional resistance is
not required but can be added for additional protection. A 1k
Ω
resistor can be used.
RECOMMENDATIONS FOR UNUSED INPUT AND OUTPUT PINS
OUTPUTS:
LVCMOS OUTPUTS
All unused LVCMOS output can be left floating. There should be
no trace attached.
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PDF描述 |
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参数描述 |
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