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参数资料
| 型号： | ICS87946AYI-147LFT |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 1/14页 |
| 文件大小： | 0K |
| 描述： | IC CLOCK GENERATOR 32-LQFP |
| 标准包装： | 1,000 |
| 系列： | HiPerClockS™ |
| 类型： | 时钟发生器 |
| PLL： | 无 |
| 输入： | LVCMOS，LVTTL |
| 输出： | LVCMOS，LVTTL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:10 |
| 差分 - 输入:输出： | 是/无 |
| 频率 - 最大： | 250MHz |
| 除法器/乘法器： | 是/无 |
| 电源电压： | 3 V ~ 3.6 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 32-LQFP |
| 供应商设备封装： | 32-TQFP（7x7） |
| 包装： | 带卷 (TR) |
| 其它名称： | 87946AYI-147LFT |
DATA SHEET
ICS87946AYI-147 REVISION A AUGUST 7, 2009
1
2009 Integrated Device Technology, Inc.
Low Skew, ÷1, ÷2 LVCMOS/LVTTL
Clock Generator
ICS87946I-147
General Description
The ICS87946I-147 is a low skew, ÷1, ÷2
LVCMOS/LVTTL Clock Generator and a member of
the HiPerClockS family of High Performance Clock
Solutions from IDT. The ICS87946I-147 has two
selectable single ended clock inputs. The single ended
clock inputs accept LVCMOS or LVTTL input levels. The low
impedance LVCMOS/LVTTL outputs are designed to drive 50
series or parallel terminated transmission lines. The effective fanout
can be increased from 10 to 20 by utilizing the ability of the outputs
to drive two series terminated lines.
The divide select inputs, DIV_SELx, control the output frequency of
each bank. The outputs can be utilized in the ÷1, ÷2 or a
combination of ÷1 and ÷2 modes. The master reset input, MR/nOE,
resets the internal frequency dividers and also controls the active
and high impedance states of all outputs.
The ICS87946I-147 is characterized at full 3.3V for input VDD, and
mixed 3.3V and 2.5V for output operating supply mode. Guaranteed
bank, output and part-to-part skew characteristics make the
ICS87946I-147 ideal for those clock distribution applications
demanding well defined performance and repeatability.
Features
Ten single ended LVCMOS/LVTTL outputs,
7
typical output impedance
Selectable LVCMOS/LVTTL CLK0 and CLK1 inputs
CLK0 and CLK1 can accept the following input levels:
LVCMOS and LVTTL
Maximum input frequency: 250MHz
Bank skew: 30ps (maximum)
Output skew: 175ps (maximum)
Part-to-part skew: 850ps (maximum)
Multiple frequency skew: 200ps (maximum)
3.3V core, 3.3V or 2.5V output supply modes
-40°C to 85°C ambient operating temperature
Available in both standard (RoHS 5) and lead-free (RoHS 6)
packages
HiPerClockS
ICS
9
10 11 12 13 14 15 16
32 31 30
29 28
27 26 25
1
2
3
4
5
6
7
8
24
23
22
21
20
19
18
17
CLK_SEL
VDD
CLK0
CLK1
DIV_SELA
DIV_SELB
DIV_SELC
GND
QB0
VDDB
QB1
GND
QB2
VDDB
VDDC
V
DDC
QC0
GND
QC1
V
DDC
QC2
GND
QC3
GND
QA0
V
DDA
QA1
GND
QA2
V
DDA
MR/nOE
ICS87946I-147
32-Lead LQFP
7mm x 7mm x 1.4mm package body
Y Package
Top View
Pin Assignment
Block Diagram
CLK0
CLK_SEL
CLK1
DIV_SELA
QA[0:2]
0
1
0
1
÷1
÷2
Pullup
Pulldown
DIV_SELB
DIV_SELC
QC[0:3]
0
1
Pulldown
MR/nOE Pulldown
QB[0:2]
0
1
0
1
Pulldown
3
4
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