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参数资料
| 型号： | ICS87946AYI-147LFT |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 12/14页 |
| 文件大小： | 0K |
| 描述： | IC CLOCK GENERATOR 32-LQFP |
| 标准包装： | 1,000 |
| 系列： | HiPerClockS™ |
| 类型： | 时钟发生器 |
| PLL： | 无 |
| 输入： | LVCMOS，LVTTL |
| 输出： | LVCMOS，LVTTL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:10 |
| 差分 - 输入:输出： | 是/无 |
| 频率 - 最大： | 250MHz |
| 除法器/乘法器： | 是/无 |
| 电源电压： | 3 V ~ 3.6 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 32-LQFP |
| 供应商设备封装： | 32-TQFP（7x7） |
| 包装： | 带卷 (TR) |
| 其它名称： | 87946AYI-147LFT |
ICS87946AYI-147 REVISION A AUGUST 7, 2009
7
2009 Integrated Device Technology, Inc.
ICS87946I-147 Data Sheet
LOW SKEW, ÷1, ÷2 LVCMOS/LVTTL CLOCK GENERATOR
Table 5B. AC Characteristics, VDD = 3.3V ± 5%, VDDA = VDDB = VDDC = 2.5V ± 5%, TA = -40°C to 85°C
NOTE: Electrical parameters are guaranteed over the specified ambient operating temperature range, which is established when the device is
mounted in a test socket with maintained transverse airflow greater than 500 lfpm. The device will meet specifications after thermal equilibrium
has been reached under these conditions.
NOTE 1: Measured from VDD/2 of the input to VDDX/2 of the output.
NOTE 2: Defined as skew within a bank of outputs at the same supply voltage and with equal load conditions.
NOTE 3: Defined as skew across banks of outputs at the same supply voltage and with equal load conditions. Measured at VDDX/2.
NOTE 4: Defined as skew across banks of outputs operating at different frequencies with the same supply voltage and equal load conditions.
NOTE 5: Defined as skew between outputs on different devices operating at the same supply voltage and with equal load conditions. Using
the same type of inputs on each device, the outputs are measured at VDDX/2.
NOTE 6: These parameters are guaranteed by characterization. Not tested in production.
NOTE 7: This parameter is defined in accordance with JEDEC Standard 65.
Symbol
Parameter
Test Conditions
Minimum
Typical
Maximum
Units
fMAX
Output Frequency
250
MHz
tPD
Propagation Delay;
NOTE 1
≤ 250MHz
2
5
ns
tsk(b)
Bank Skew, NOTE 2, 7
Measured on rising edge at VDDX/2
35
ps
tsk(o)
Output Skew; NOTE 3, 7
Measured on rising edge at VDDX/2
175
ps
tsk(w)
Multiple Frequency Skew;
NOTE 4, 7
Measured on rising edge at VDDX/2
200
ps
tsk(pp)
Part-to-Part Skew;
NOTE 5, 7
Measured on rising edge at VDDX/2
875
ps
tR / tF
Output Rise/Fall Time;
NOTE 6
20% to 80%
400
950
ps
tPW
Output Pulse Width
tPERIOD/2 - 1
tPERIOD/2
tPERIOD/2 + 1
%
tEN
Output Enable Time;
NOTE 6
= 10MHz
3
ns
tDIS
Output Disable Time;
NOTE 6
= 10MHz
3
ns
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