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参数资料
| 型号： | ICS889872AKLF |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | 时钟及定时 |
| 英文描述： | DIFFERENTIAL-TO-LVDS BUFFER/DIVIDER W/INTERNAL TERMINATION |
| 中文描述： | 889872 SERIES, LOW SKEW CLOCK DRIVER, 3 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), QCC16 |
| 封装： | 3 X 3 MM, 0.95 MM HEIGHT, ROHS COMPLIANT, MO-220VEED-2/-4, VFQFN-16 |
| 文件页数： | 1/14页 |
| 文件大小： | 649K |
| 代理商： | ICS889872AKLF |
PRELIMINARY
DIFFERENTIAL-TO-LVDS BUFFER/DIVIDER
W/INTERNAL TERMINATION
ICS889872
IDT / ICS
LVDS BUFFER/DIVIDER W/INTERNAL TERMINATION
1
ICS889872AK REV. A AUGUST 22, 2007
General Description
The ICS889872 is a high speed Differential-to-
LVDS Buffer/Divider w/Internal Termination and is a
member of the HiPerClockSfamily of high
performance clock solutions from IDT. The
ICS889872 has a selectable ÷2, ÷4, ÷8, ÷16 output
dividers. The clock input has internal termination resistors,
allowing it to interface with several differential signal types while
minimizing the number of required external components. The
device is packaged in a small, 3mm x 3mm VFQFN package,
making it ideal for use on space-constrained boards.
Features
Three LVDS outputs
Frequency divide select options: ÷4, ÷6: >2GHz,
÷8, ÷16: >1.6GHz
IN, nIN input can accept the following differential input levels:
LVPECL, LVDS, CML
Output frequency: >2GHz
Cycle-to-cycle jitter: 1ps (typical)
Total jitter: 10ps (typical)
Output skew: 7ps (typical), QA/nQA outputs
Part-to-part skew: 250ps (typical)
Propagation Delay: 750ps (typical), QA/nQA outputs
Full 2.5V supply mode
-40°C to 85°C ambient operating temperature
Available in both standard (RoHS 5) and lead-free (RoHS 6)
packages
HiPerClockS
ICS
ICS889872
16-Lead VFQFN
3mm x 3mm x 0.95mm package body
K Package
Top View
The Preliminary Information presented herein represents a product in pre-production. The noted characteristics are based on initial product characterization and/or qualification.
Integrated Device Technology, Incorporated (IDT) reserves the right to change any circuitry or specifications without notice.
Block Diagram
Pin Assignment
Decoder
÷2, ÷4,
÷8, ÷16
50
50
Enable
FF
Enable
MUX
QA
nQA
QB0
nQB0
QB1
nQB1
nRESET/
nDISABLE
IN
V
T
V
REF_AC
S1
S0
nIN
5
6
7
8
16 15 14 13
1
2
3
4
12
11
10
9
QB0
nQB0
QB1
nQB1
IN
V
T
V
REF_AC
nIN
Q
n
V
D
n
n
S
V
D
G
S
相关PDF资料 |
PDF描述 |
|---|---|
| ICS889872AKLFT | DIFFERENTIAL-TO-LVDS BUFFER/DIVIDER W/INTERNAL TERMINATION |
| ICS889872AKT | DIFFERENTIAL-TO-LVDS BUFFER/DIVIDER W/INTERNAL TERMINATION |
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| ICS98UAE877AHLFIT | 1.5V LOW-POWER WIDE-RANGE FREQUENCY CLOCK DRIVER |
| ICS98UAE877AHLFT | 1.5V LOW-POWER WIDE-RANGE FREQUENCY CLOCK DRIVER |
相关代理商/技术参数 |
参数描述 |
|---|---|
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