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参数资料
| 型号： | ICS91730YMLF-T |
| 英文描述： | Low EMI, Spread Modulating, Clock Generator |
| 中文描述： | 低EMI，扩展调制，时钟发生器 |
| 文件页数： | 3/11页 |
| 文件大小： | 139K |
| 代理商： | ICS91730YMLF-T |
3
ICS91730
0794D—05/23/05
Table 1: Frequency Configuration Table
(See I2C Byte 0)
Above is the hard coded 5 bit (32 entry) ROM table.
FS3:0 are ONLY accessible through I2C software programming bits (byte0 bits5:7). FS4 can also be decoded from
FS_IN1 latched input hardware pins.
FS_IN1
→
FS4. Upon power-up the default is to use hardware selection of FS_IN1 latched value.
FS3 = 0, FS2
=
0, FS1 = 0, FS0 = 1 upon power-up (refer to the functionality table on page 1).
To access non-default spread entries in the ROM, byte0 programming should be used. In order to change the power
up default of FS_IN1 = 1 (-1.25% down spread) to any other spread % entry, first change byte0bit 0 to software
selection by switching this bit to a ‘1’ and then program the desired percentage by changing byte0 bits 7:3.
FS4
0
0
0
0
0
0
0
0
0
0
0
0
FS3
0
0
0
0
0
0
0
0
1
1
1
1
FS2
0
0
0
0
1
1
1
1
0
0
0
0
FS1
0
0
1
1
0
0
1
1
0
0
1
1
FS0
0
1
0
1
0
1
0
1
0
1
0
1
Sprd Type Sprd %
0.60
0.80
1.00
1.25
1.50
2.00
0.50
1.00
0.60
1.00
0.80
0.3
CTR SPD
0
1
1
0
0
1.50
1.75
2.00
2.50
3.00
1.25
0.40
0.50
0.70
1.00
1.20
1.50
0.60
0.80
1.00
1.25
1.50
2.00
0.50
1.00
0
0
0
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
0
0
0
0
0
0
0
0
1
1
1
1
1
1
1
1
1
1
1
0
0
0
0
1
1
1
1
0
0
0
0
1
1
1
1
0
1
1
0
0
1
1
0
0
1
1
0
0
1
1
0
0
1
1
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
48in/48out
66in/66out
DOWN
SPREAD
(-)
CENTER SPD
(+/-)
14in/27out
DOWN
SPREAD
(-)
CENTER SPD
(+/-)
14in/14out
27in/27out
CENTER SPD
(+/-)
DOWN
SPREAD
(-)
DOWN
SPREAD
(-)
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