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参数资料
| 型号： | ICS94225YFLF-T |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | 时钟产生/分配 |
| 英文描述： | 133.33 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO48 |
| 封装： | 0.300 INCH, MO-118, SSOP-48 |
| 文件页数： | 1/18页 |
| 文件大小： | 146K |
| 代理商： | ICS94225YFLF-T |
Integrated
Circuit
Systems, Inc.
ICS94225
0445B—08/01/03
Block Diagram
Functionality
Pin Configuration
48-Pin 300mil SSOP
Recommended Application:
AMD 750/760 style chipset
Output Features:
3 differential pair open drain CPU clocks (1.5V
external
pull-up; up to 150MHz achieviable through I
2C)
2 - AGPCLK @ 3.3V
8 - PCI @3.3V, including 1 free running
1 - 48MHz @ 3.3V
1 - 24/48MHz @ 3.3V
2- REF @3.3V, 14.318MHz.
Features:
Programmable ouput frequency
Programmable ouput rise/fall time
Programmable group skew
Real time system reset output
Spread spectrum for EMI control typically
by 7dB to 8dB,
with programmable spread percentage
Watchdog timer technology to reset system
if over-clocking causes malfunction
Uses external 14.318MHz crystal
AMD-K7TM System Clock Chip
* Internal 120K pullup resistor on indicated inputs
** Internal 240K pullup resistor on indicated inputs
**FS0/REF0
**FS1/REF1
GNDREF
X1
X2
GNDPCI
PCICLK_F
PCICLK0
VDDPCI
PCICLK1
PCICLK2
GNDPCI
PCICLK3
PCICLK4
VDDPCI
PCICLK5
PCICLK6
VDDAGP
AGP0
AGP1
GNDAGP
VDD48
48MHz
SEL24_48#/24-48MHz
VDDREF
GNDSD
SDRAM_OUT
VDDSD
RESERVED
CPUCLKC2
CPUCLKT2
GNDCPU
CPUCLKC1
CPUCLKT1
GND
CPUCLKC0
CPUCLKT0
RESET#
VDD
GND
PCI_STOP#
CPU_STOP#
PD#
SPREAD#
FS2*
SDATA
SCLK
GND48
ICS94225
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
48
47
46
45
44
43
42
41
40
39
38
37
36
35
34
33
32
31
30
29
28
27
26
25
Power Groups
VDD48, GND48 = 48MHz, PLL2
VDDREF, GNDREF= REF, X1, X2
VDD, GND = PLL Core
0
133.33
33.33
66.67
0
1
95
31.67
63.33
0
1
0
100.99
33.66
67.33
0
1
115
38.33
76.67
1
0
100.7
33.57
67.13
1
0
1
103
34.33
68.67
1
0
105
35.00
70.00
1
110
36.67
73.33
PCI
AGP
FS2
FS1
FS0
CPU,
SDRAM
SEL24_48#
SDATA
SCLK
FS (2:0)
PD#
PCI_STOP#
CPU_STOP#
SPREAD#
PLL2
PLL1
Spread
Spectrum
48MHz
24_48MHz
SDRAM_OUT
PCICLK (6:0)
AGP (1:0)
PCICLK_F
2
7
X1
X2
XTAL
OSC
CPU
DIVDER
SDRAM
DIVDER
PCI
DIVDER
AGP
DIVDER
Stop
Control
Logic
Config.
Reg.
/ 2
REF (1:0)
3
CPUCLKT (2:0)
CPUCLKC (2:0)
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PDF描述 |
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