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参数资料
| 型号： | ICS94225YFLF-T |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | 时钟产生/分配 |
| 英文描述： | 133.33 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO48 |
| 封装： | 0.300 INCH, MO-118, SSOP-48 |
| 文件页数： | 12/18页 |
| 文件大小： | 146K |
| 代理商： | ICS94225YFLF-T |
3
ICS94225
0445B—08/01/03
Byte 1: Reserved Active/Inactive Register
(1= enable, 0 = disable)
Byte 2: Reserved, Active/Inactive Register
(1= enable, 0 = disable)
Notes:
1. Inactive means outputs are held LOW and are disabled
from switching.
2. Latched Frequency Selects (FS#) will be inverted logic
load of the input frequency select pin conditions.
T
I
B#
N
I
PD
W
PN
O
I
T
P
I
R
C
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D
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1
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3
,
6
31
0
T
/
C
K
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C
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P
C
Byte 4: Clock Control Register
(1= enable, 0 = disable)
T
I
B#
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I
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W
PN
O
I
T
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I
R
C
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P
56
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4
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C
I
C
P
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3
K
L
C
I
C
P
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2
K
L
C
I
C
P
10
11
1
K
L
C
I
C
P
08
1
0
K
L
C
I
C
P
Byte 5: PCI Clock Control Register
(1= enable, 0 = disable)
Byte 3: Reserved Active/Inactive Register
(1= enable, 0 = disable)
T
I
B#
N
I
PD
W
PN
O
I
T
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I
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)
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