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参数资料
| 型号： | ICS95V157YGLF |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | 时钟及定时 |
| 英文描述： | PLL BASED CLOCK DRIVER, 10 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO48 |
| 封装： | 6.10 MM, TSSOP-48 |
| 文件页数： | 1/9页 |
| 文件大小： | 349K |
| 代理商： | ICS95V157YGLF |
Integrated
Circuit
Systems, Inc.
ICS95V157
Advance Information
0501—08/22/02
Block Diagram
2.5V Wide Range Frequency Clock Driver (33MHz - 233MHz)
Pin Configuration
48-Pin TSSOP
Recommended Application:
Single-ended clock input with zero delay board fan out
Product Description/Features:
Low skew, low jitter PLL clock driver
1 to 10 differential clock distribution (SSTL2)
Feedback pin for input to output synchronization
PD for power management
Spread Spectrum tolerant inputs
Switching Characteristics:
CYCLE - CYCLE jitter (>100MHz):<60ps
OUTPUT - OUTPUT skew: <40ps
Output Rise and Fall Time: 650ps - 950ps
DUTY CYCLE: 49.5% - 50.5%
Functionality
6.10 mm. Body, 0.50 mm. pitch = TSSOP
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ICS reserves the right to change or discontinue these products without notice. Third party brands and names are the property of their respective owners.
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