参数资料
型号: ICS9DB104YGLNT
厂商: INTEGRATED DEVICE TECHNOLOGY INC
元件分类: 时钟及定时
英文描述: 9DB SERIES, PLL BASED CLOCK DRIVER, 4 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO28
封装: 4.40 MM, 0.65 MM, ROHS COMPLIANT, MO-153, TSSOP-28
文件页数: 12/14页
文件大小: 137K
代理商: ICS9DB104YGLNT
7
Integrated
Circuit
Systems, Inc.
ICS9DB104
(Not recommended for new designs)
0767E—12/14/07
SMBus Table: Frequency Select Register, READ/WRITE ADDRESS (DC/DD)
Pin #
Name
Control
Function
Type
0
1
PWD
Bit 7
RW
driven
Hi-Z
0
Bit 6
RW
driven
Hi-Z
0
Bit 5
RW
X
Bit 4
RW
X
Bit 3
RW
X
Bit 2
RW High BW Low BW
1
Bit 1
RW
fan-out
ZDB
1
Bit 0
RW
div /2
x1
1
SMBus Table: Output Control Register
Pin #
Name
Control
Function
Type
0
1
PWD
Bit 7
RW
1
Bit 6
DIF_6
Output
Control
RW
Disable
Enable
1
Bit 5
DIF_5
Output
Control
RW
Disable
Enable
1
Bit 4
RW
1
Bit 3
RW
1
Bit 2
DIF_2
Output
Control
RW
Disable
Enable
1
Bit 1
DIF_1
Output
Control
RW
Disable
Enable
1
Bit 0
RW
1
SMBus Table: Output Control Register
Pin #
Name
Control
Function
Type
0
1
PWD
Bit 7
RW
0
Bit 6
DIF_6
Output
Control
RW
Free-run Stoppable
0
Bit 5
DIF_5
Output
Control
RW
Free-run Stoppable
0
Bit 4
RW
0
Bit 3
RW
0
Bit 2
DIF_2
Output
Control
RW
Free-run Stoppable
0
Bit 1
DIF_1
Output
Control
RW
Free-run Stoppable
0
Bit 0
RW
0
Reserved
User should write '0'
to minimize power
Reserved
User should write '0'
to minimize power
Reserved
User should write '0'
to minimize power
Reserved
User should write '0'
to minimize power
6,7
-
Reserved
20,19
-
9,10
-
Byte 2
-
23,22
-
9,10
6,7
Byte 1
-
23,22
20,19
-
BYPASS#/PLL
-
SRC_DIV#
-
Reserved
-
PLL_BW# adjust
-
Reserved
-
Reserved
Byte 0
-
PD# drive mode
-
SRC_Stop# drive
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