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参数资料
| 型号： | ICS9FG108CG-T |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | 时钟产生/分配 |
| 英文描述： | 400 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO48 |
| 封装： | 6.10 MM, 0.50 MM PITCH, MO-153, TSSOP-48 |
| 文件页数： | 3/19页 |
| 文件大小： | 229K |
| 代理商： | ICS9FG108CG-T |
11
Integrated
Circuit
Systems, Inc.
ICS9FG108
0823E—04/13/06
SMBus Table: Byte Count Register
Pin #
Name
Control Function
Type0
1
PWD
Bit 7
BC7
RW
-
0
Bit 6
BC6
RW
-
0
Bit 5
BC5
RW
-
0
Bit 4
BC4
RW
-
0
Bit 3
BC3
RW
-
0
Bit 2
BC2
RW
-
1
Bit 1
BC1
RW
-
1
Bit 0
BC0
RW
-
1
SMBus Table: Reserved Register
Pin #
Name
Control Function
Type0
1
PWD
Bit 7
X
Bit 6
X
Bit 5
X
Bit 4
X
Bit 3
X
Bit 2
X
Bit 1
X
Bit 0
X
SMBus Table: Reserved Register
Pin #
Name
Control Function
Type0
1
PWD
Bit 7
X
Bit 6
X
Bit 5
X
Bit 4
X
Bit 3
X
Bit 2
X
Bit 1
X
Bit 0
X
SMBus Table: M/N Programming Enable
Pin #
Name
Control Function
Type0
1
PWD
Bit 7
M/N_EN
PLL M/N Programming
Enable
RW
Disable
Enable
0
Bit 6
OE_Polarity
Select Polarity of OE
inputs
RW
OE#
OE
1
Bit 5
REFOUT_En
Enables/Disables REF
RW
Disable
Enable
1
Bit 4
0
Bit 3
0
Bit 2
0
Bit 1
0
Bit 0
0
Reserved
Byte 8
Reserved
Byte 7
Reserved
5
Reserved
Byte 9
-
Byte 6
Writing to this register
will configure how many
bytes will be read back,
default is 07 = 7 bytes.
-
相关PDF资料 |
PDF描述 |
|---|---|
| ICSSSTUAF32868BHLFT | 32868 SERIES, POSITIVE EDGE TRIGGERED D FLIP-FLOP, TRUE OUTPUT, PBGA176 |
| IDT2309-1HDCGI8 | PLL BASED CLOCK DRIVER, 8 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO16 |
| IDT54FCT373CTEB | FCT SERIES, 8-BIT DRIVER, TRUE OUTPUT, CDFP20 |
| IDT5V996BBI | 5V SERIES, PLL BASED CLOCK DRIVER, 8 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PBGA144 |
| IDT5V996BBI8 | 5V SERIES, PLL BASED CLOCK DRIVER, 8 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PBGA144 |
相关代理商/技术参数 |
参数描述 |
|---|---|
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